| module user_project_wrapper (user_clock2, |
| vccd1, |
| vccd2, |
| vdda1, |
| vdda2, |
| vssa1, |
| vssa2, |
| vssd1, |
| vssd2, |
| wb_clk_i, |
| wb_rst_i, |
| wbs_ack_o, |
| wbs_cyc_i, |
| wbs_stb_i, |
| wbs_we_i, |
| analog_io, |
| io_in, |
| io_oeb, |
| io_out, |
| la_data_in, |
| la_data_out, |
| la_oenb, |
| user_irq, |
| wbs_adr_i, |
| wbs_dat_i, |
| wbs_dat_o, |
| wbs_sel_i); |
| input user_clock2; |
| input vccd1; |
| input vccd2; |
| input vdda1; |
| input vdda2; |
| input vssa1; |
| input vssa2; |
| input vssd1; |
| input vssd2; |
| input wb_clk_i; |
| input wb_rst_i; |
| output wbs_ack_o; |
| input wbs_cyc_i; |
| input wbs_stb_i; |
| input wbs_we_i; |
| inout [28:0] analog_io; |
| input [37:0] io_in; |
| output [37:0] io_oeb; |
| output [37:0] io_out; |
| input [127:0] la_data_in; |
| output [127:0] la_data_out; |
| input [127:0] la_oenb; |
| output [2:0] user_irq; |
| input [31:0] wbs_adr_i; |
| input [31:0] wbs_dat_i; |
| output [31:0] wbs_dat_o; |
| input [3:0] wbs_sel_i; |
| |
| wire one_; |
| wire zero_; |
| wire prog_we_o; |
| wire prog_dout; |
| |
| top dut (.ipin_x0y1_0(io_in[36]), |
| .ipin_x0y1_1(io_in[31]), |
| .ipin_x0y2_0(io_in[30]), |
| .ipin_x0y3_0(io_in[29]), |
| .ipin_x0y4_0(io_in[28]), |
| .ipin_x0y5_0(io_in[27]), |
| .ipin_x0y6_0(io_in[26]), |
| .ipin_x0y7_0(io_in[25]), |
| .ipin_x0y8_0(io_in[24]), |
| .ipin_x1y9_0(io_in[23]), |
| .ipin_x2y9_0(io_in[22]), |
| .ipin_x2y9_1(io_in[21]), |
| .ipin_x3y9_0(io_in[20]), |
| .ipin_x4y9_0(io_in[19]), |
| .ipin_x5y9_0(io_in[18]), |
| .ipin_x6y9_0(io_in[17]), |
| .ipin_x7y9_0(io_in[16]), |
| .ipin_x8y9_1(io_in[15]), |
| .ipin_x9y1_0(io_in[2]), |
| .ipin_x9y1_1(io_in[3]), |
| .ipin_x9y2_0(io_in[4]), |
| .ipin_x9y2_1(io_in[5]), |
| .ipin_x9y3_0(io_in[6]), |
| .ipin_x9y3_1(io_in[7]), |
| .ipin_x9y4_0(io_in[8]), |
| .ipin_x9y5_0(io_in[9]), |
| .ipin_x9y5_1(io_in[10]), |
| .ipin_x9y6_0(io_in[11]), |
| .ipin_x9y7_0(io_in[12]), |
| .ipin_x9y7_1(io_in[13]), |
| .ipin_x9y8_0(io_in[14]), |
| .oe_x0y1_1(io_oeb[31]), |
| .oe_x0y2_0(io_oeb[30]), |
| .oe_x0y3_0(io_oeb[29]), |
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| .oe_x2y9_1(io_oeb[21]), |
| .oe_x3y9_0(io_oeb[20]), |
| .oe_x4y9_0(io_oeb[19]), |
| .oe_x5y9_0(io_oeb[18]), |
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| .oe_x7y9_0(io_oeb[16]), |
| .oe_x8y9_1(io_oeb[15]), |
| .oe_x9y1_0(io_oeb[2]), |
| .oe_x9y1_1(io_oeb[3]), |
| .oe_x9y2_0(io_oeb[4]), |
| .oe_x9y2_1(io_oeb[5]), |
| .oe_x9y3_0(io_oeb[6]), |
| .oe_x9y3_1(io_oeb[7]), |
| .oe_x9y4_0(io_oeb[8]), |
| .oe_x9y5_0(io_oeb[9]), |
| .oe_x9y5_1(io_oeb[10]), |
| .oe_x9y6_0(io_oeb[11]), |
| .oe_x9y7_0(io_oeb[12]), |
| .oe_x9y7_1(io_oeb[13]), |
| .oe_x9y8_0(io_oeb[14]), |
| .opin_x0y1_1(io_out[31]), |
| .opin_x0y2_0(io_out[30]), |
| .opin_x0y3_0(io_out[29]), |
| .opin_x0y4_0(io_out[28]), |
| .opin_x0y5_0(io_out[27]), |
| .opin_x0y6_0(io_out[26]), |
| .opin_x0y7_0(io_out[25]), |
| .opin_x0y8_0(io_out[24]), |
| .opin_x1y9_0(io_out[23]), |
| .opin_x2y9_0(io_out[22]), |
| .opin_x2y9_1(io_out[21]), |
| .opin_x3y9_0(io_out[20]), |
| .opin_x4y9_0(io_out[19]), |
| .opin_x5y9_0(io_out[18]), |
| .opin_x6y9_0(io_out[17]), |
| .opin_x7y9_0(io_out[16]), |
| .opin_x8y9_1(io_out[15]), |
| .opin_x9y1_0(io_out[2]), |
| .opin_x9y1_1(io_out[3]), |
| .opin_x9y2_0(io_out[4]), |
| .opin_x9y2_1(io_out[5]), |
| .opin_x9y3_0(io_out[6]), |
| .opin_x9y3_1(io_out[7]), |
| .opin_x9y4_0(io_out[8]), |
| .opin_x9y5_0(io_out[9]), |
| .opin_x9y5_1(io_out[10]), |
| .opin_x9y6_0(io_out[11]), |
| .opin_x9y7_0(io_out[12]), |
| .opin_x9y7_1(io_out[13]), |
| .opin_x9y8_0(io_out[14]), |
| .prog_clk(io_in[37]), |
| .prog_din(io_in[35]), |
| .prog_done(io_in[34]), |
| .prog_dout(prog_dout), |
| .prog_rst(io_in[33]), |
| .prog_we(io_in[32]), |
| .prog_we_o(prog_we_o), |
| .vccd1(vccd1), |
| .vssd1(vssd1)); |
| assign io_oeb[0] = one_; |
| assign io_oeb[1] = one_; |
| assign io_oeb[32] = zero_; |
| assign io_oeb[33] = zero_; |
| assign io_oeb[34] = zero_; |
| assign io_oeb[35] = zero_; |
| assign io_oeb[36] = zero_; |
| assign io_oeb[37] = zero_; |
| assign io_out[0] = prog_we_o; |
| assign io_out[1] = prog_dout; |
| assign io_out[32] = zero_; |
| assign io_out[33] = zero_; |
| assign io_out[34] = zero_; |
| assign io_out[35] = zero_; |
| assign io_out[36] = zero_; |
| assign io_out[37] = zero_; |
| assign la_data_out[0] = zero_; |
| assign la_data_out[100] = zero_; |
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| assign la_data_out[110] = zero_; |
| assign la_data_out[111] = zero_; |
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| assign la_data_out[116] = zero_; |
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| assign la_data_out[119] = zero_; |
| assign la_data_out[11] = zero_; |
| assign la_data_out[120] = zero_; |
| assign la_data_out[121] = zero_; |
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| assign la_data_out[124] = zero_; |
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| assign wbs_ack_o = zero_; |
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| endmodule |