| module user_project_wrapper (user_clock2, |
| vccd1, |
| vccd2, |
| vdda1, |
| vdda2, |
| vssa1, |
| vssa2, |
| vssd1, |
| vssd2, |
| wb_clk_i, |
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| wbs_ack_o, |
| wbs_cyc_i, |
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| analog_io, |
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| io_oeb, |
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| la_data_in, |
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| la_oenb, |
| user_irq, |
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| input user_clock2; |
| input vccd1; |
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| input vssa1; |
| input vssa2; |
| input vssd1; |
| input vssd2; |
| input wb_clk_i; |
| input wb_rst_i; |
| output wbs_ack_o; |
| input wbs_cyc_i; |
| input wbs_stb_i; |
| input wbs_we_i; |
| inout [28:0] analog_io; |
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| output [37:0] io_oeb; |
| output [37:0] io_out; |
| input [127:0] la_data_in; |
| output [127:0] la_data_out; |
| input [127:0] la_oenb; |
| output [2:0] user_irq; |
| input [31:0] wbs_adr_i; |
| input [31:0] wbs_dat_i; |
| output [31:0] wbs_dat_o; |
| input [3:0] wbs_sel_i; |
| |
| wire bist_clk; |
| wire bist_done; |
| wire bist_en; |
| wire bist_load; |
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| wire bist_sdi; |
| wire bist_sdo; |
| wire bist_shift; |
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| wire \func_addr_a[7] ; |
| wire \func_addr_a[8] ; |
| wire \func_addr_a[9] ; |
| wire \func_addr_b[0] ; |
| wire \func_addr_b[1] ; |
| wire \func_addr_b[2] ; |
| wire \func_addr_b[3] ; |
| wire \func_addr_b[4] ; |
| wire \func_addr_b[5] ; |
| wire \func_addr_b[6] ; |
| wire \func_addr_b[7] ; |
| wire \func_addr_b[8] ; |
| wire \func_addr_b[9] ; |
| wire func_cen_a; |
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| wire func_clk_a; |
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| |
| mbist_top u_mbist (.bist_clk(bist_clk), |
| .bist_done(bist_done), |
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| \func_addr_b[4] , |
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