mpw_precheck/logs/spdx_compliance_report.log

/root/zero_to_asic_mpw3_rerun_on_mpw5/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/docs/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/docs/environment.yml
/root/zero_to_asic_mpw3_rerun_on_mpw5/docs/source/conf.py
/root/zero_to_asic_mpw3_rerun_on_mpw5/docs/source/index.rst
/root/zero_to_asic_mpw3_rerun_on_mpw5/openlane/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/openlane/user_proj_example/config.tcl
/root/zero_to_asic_mpw3_rerun_on_mpw5/openlane/user_project_wrapper/config.tcl
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/io_ports/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/io_ports/io_ports.c
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/io_ports/io_ports_tb.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/la_test1/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/la_test1/la_test1.c
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/la_test1/la_test1_tb.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/la_test2/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/la_test2/la_test2.c
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/la_test2/la_test2_tb.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/mprj_stimulus/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/mprj_stimulus/mprj_stimulus.c
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/mprj_stimulus/mprj_stimulus_tb.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/wb_port/Makefile
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/wb_port/wb_port.c
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/dv/wb_port/wb_port_tb.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/rtl/uprj_netlists.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/rtl/user_proj_example.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/rtl/user_project_includes.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/rtl/user_project_wrapper.v
/root/zero_to_asic_mpw3_rerun_on_mpw5/verilog/rtl/wrapped_rgb_mixer/wrapper.v