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| /* Generated by Yosys 0.9+3621 (git sha1 84e9fa7, gcc 8.3.1 -fPIC -Os) */ |
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| module caravan(vddio, vddio_2, vssio, vssio_2, vdda, vssa, vccd, vssd, vdda1, vdda1_2, vdda2, vssa1, vssa1_2, vssa2, vccd1, vccd2, vssd1, vssd2, gpio, mprj_io, pwr_ctrl_out, clock, resetb, flash_csb, flash_clk, flash_io0, flash_io1); |
| wire caravel_clk; |
| wire caravel_clk2; |
| wire caravel_rstn; |
| input clock; |
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| output flash_clk; |
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| output flash_csb; |
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| wire \mprj_io_out[11] ; |
| wire \mprj_io_out[12] ; |
| wire \mprj_io_out[13] ; |
| wire \mprj_io_out[14] ; |
| wire \mprj_io_out[15] ; |
| wire \mprj_io_out[16] ; |
| wire \mprj_io_out[17] ; |
| wire \mprj_io_out[18] ; |
| wire \mprj_io_out[19] ; |
| wire \mprj_io_out[1] ; |
| wire \mprj_io_out[20] ; |
| wire \mprj_io_out[21] ; |
| wire \mprj_io_out[22] ; |
| wire \mprj_io_out[23] ; |
| wire \mprj_io_out[24] ; |
| wire \mprj_io_out[25] ; |
| wire \mprj_io_out[26] ; |
| wire \mprj_io_out[2] ; |
| wire \mprj_io_out[3] ; |
| wire \mprj_io_out[4] ; |
| wire \mprj_io_out[5] ; |
| wire \mprj_io_out[6] ; |
| wire \mprj_io_out[7] ; |
| wire \mprj_io_out[8] ; |
| wire \mprj_io_out[9] ; |
| wire \mprj_io_slow_sel[0] ; |
| wire \mprj_io_slow_sel[10] ; |
| wire \mprj_io_slow_sel[11] ; |
| wire \mprj_io_slow_sel[12] ; |
| wire \mprj_io_slow_sel[13] ; |
| wire \mprj_io_slow_sel[14] ; |
| wire \mprj_io_slow_sel[15] ; |
| wire \mprj_io_slow_sel[16] ; |
| wire \mprj_io_slow_sel[17] ; |
| wire \mprj_io_slow_sel[18] ; |
| wire \mprj_io_slow_sel[19] ; |
| wire \mprj_io_slow_sel[1] ; |
| wire \mprj_io_slow_sel[20] ; |
| wire \mprj_io_slow_sel[21] ; |
| wire \mprj_io_slow_sel[22] ; |
| wire \mprj_io_slow_sel[23] ; |
| wire \mprj_io_slow_sel[24] ; |
| wire \mprj_io_slow_sel[25] ; |
| wire \mprj_io_slow_sel[26] ; |
| wire \mprj_io_slow_sel[2] ; |
| wire \mprj_io_slow_sel[3] ; |
| wire \mprj_io_slow_sel[4] ; |
| wire \mprj_io_slow_sel[5] ; |
| wire \mprj_io_slow_sel[6] ; |
| wire \mprj_io_slow_sel[7] ; |
| wire \mprj_io_slow_sel[8] ; |
| wire \mprj_io_slow_sel[9] ; |
| wire \mprj_io_vtrip_sel[0] ; |
| wire \mprj_io_vtrip_sel[10] ; |
| wire \mprj_io_vtrip_sel[11] ; |
| wire \mprj_io_vtrip_sel[12] ; |
| wire \mprj_io_vtrip_sel[13] ; |
| wire \mprj_io_vtrip_sel[14] ; |
| wire \mprj_io_vtrip_sel[15] ; |
| wire \mprj_io_vtrip_sel[16] ; |
| wire \mprj_io_vtrip_sel[17] ; |
| wire \mprj_io_vtrip_sel[18] ; |
| wire \mprj_io_vtrip_sel[19] ; |
| wire \mprj_io_vtrip_sel[1] ; |
| wire \mprj_io_vtrip_sel[20] ; |
| wire \mprj_io_vtrip_sel[21] ; |
| wire \mprj_io_vtrip_sel[22] ; |
| wire \mprj_io_vtrip_sel[23] ; |
| wire \mprj_io_vtrip_sel[24] ; |
| wire \mprj_io_vtrip_sel[25] ; |
| wire \mprj_io_vtrip_sel[26] ; |
| wire \mprj_io_vtrip_sel[2] ; |
| wire \mprj_io_vtrip_sel[3] ; |
| wire \mprj_io_vtrip_sel[4] ; |
| wire \mprj_io_vtrip_sel[5] ; |
| wire \mprj_io_vtrip_sel[6] ; |
| wire \mprj_io_vtrip_sel[7] ; |
| wire \mprj_io_vtrip_sel[8] ; |
| wire \mprj_io_vtrip_sel[9] ; |
| wire mprj_reset; |
| wire \mprj_sel_o_core[0] ; |
| wire \mprj_sel_o_core[1] ; |
| wire \mprj_sel_o_core[2] ; |
| wire \mprj_sel_o_core[3] ; |
| wire \mprj_sel_o_user[0] ; |
| wire \mprj_sel_o_user[1] ; |
| wire \mprj_sel_o_user[2] ; |
| wire \mprj_sel_o_user[3] ; |
| wire mprj_stb_o_core; |
| wire mprj_stb_o_user; |
| wire mprj_vcc_pwrgood; |
| wire mprj_vdd_pwrgood; |
| wire mprj_we_o_core; |
| wire mprj_we_o_user; |
| wire \one_loop1[0] ; |
| wire \one_loop1[10] ; |
| wire \one_loop1[11] ; |
| wire \one_loop1[1] ; |
| wire \one_loop1[2] ; |
| wire \one_loop1[3] ; |
| wire \one_loop1[4] ; |
| wire \one_loop1[5] ; |
| wire \one_loop1[6] ; |
| wire \one_loop1[7] ; |
| wire \one_loop1[8] ; |
| wire \one_loop1[9] ; |
| wire \one_loop2[0] ; |
| wire \one_loop2[10] ; |
| wire \one_loop2[1] ; |
| wire \one_loop2[2] ; |
| wire \one_loop2[3] ; |
| wire \one_loop2[4] ; |
| wire \one_loop2[5] ; |
| wire \one_loop2[6] ; |
| wire \one_loop2[7] ; |
| wire \one_loop2[8] ; |
| wire \one_loop2[9] ; |
| wire por_l; |
| wire porb_h; |
| wire porb_l; |
| output [3:0] pwr_ctrl_out; |
| input resetb; |
| wire rstb_h; |
| wire rstb_l; |
| wire sdo_out; |
| wire sdo_outenb; |
| wire \spi_ro_config_core[0] ; |
| wire \spi_ro_config_core[1] ; |
| wire \spi_ro_config_core[2] ; |
| wire \spi_ro_config_core[3] ; |
| wire \spi_ro_config_core[4] ; |
| wire \spi_ro_config_core[5] ; |
| wire \spi_ro_config_core[6] ; |
| wire \spi_ro_config_core[7] ; |
| wire \user_analog[0] ; |
| wire \user_analog[10] ; |
| wire \user_analog[1] ; |
| wire \user_analog[2] ; |
| wire \user_analog[3] ; |
| wire \user_analog[4] ; |
| wire \user_analog[5] ; |
| wire \user_analog[6] ; |
| wire \user_analog[7] ; |
| wire \user_analog[8] ; |
| wire \user_analog[9] ; |
| wire \user_clamp_high[0] ; |
| wire \user_clamp_high[1] ; |
| wire \user_clamp_high[2] ; |
| wire \user_clamp_low[0] ; |
| wire \user_clamp_low[1] ; |
| wire \user_clamp_low[2] ; |
| wire \user_gpio_analog[0] ; |
| wire \user_gpio_analog[10] ; |
| wire \user_gpio_analog[11] ; |
| wire \user_gpio_analog[12] ; |
| wire \user_gpio_analog[13] ; |
| wire \user_gpio_analog[14] ; |
| wire \user_gpio_analog[15] ; |
| wire \user_gpio_analog[16] ; |
| wire \user_gpio_analog[17] ; |
| wire \user_gpio_analog[1] ; |
| wire \user_gpio_analog[2] ; |
| wire \user_gpio_analog[3] ; |
| wire \user_gpio_analog[4] ; |
| wire \user_gpio_analog[5] ; |
| wire \user_gpio_analog[6] ; |
| wire \user_gpio_analog[7] ; |
| wire \user_gpio_analog[8] ; |
| wire \user_gpio_analog[9] ; |
| wire \user_gpio_noesd[0] ; |
| wire \user_gpio_noesd[10] ; |
| wire \user_gpio_noesd[11] ; |
| wire \user_gpio_noesd[12] ; |
| wire \user_gpio_noesd[13] ; |
| wire \user_gpio_noesd[14] ; |
| wire \user_gpio_noesd[15] ; |
| wire \user_gpio_noesd[16] ; |
| wire \user_gpio_noesd[17] ; |
| wire \user_gpio_noesd[1] ; |
| wire \user_gpio_noesd[2] ; |
| wire \user_gpio_noesd[3] ; |
| wire \user_gpio_noesd[4] ; |
| wire \user_gpio_noesd[5] ; |
| wire \user_gpio_noesd[6] ; |
| wire \user_gpio_noesd[7] ; |
| wire \user_gpio_noesd[8] ; |
| wire \user_gpio_noesd[9] ; |
| wire \user_io_in[0] ; |
| wire \user_io_in[10] ; |
| wire \user_io_in[11] ; |
| wire \user_io_in[12] ; |
| wire \user_io_in[13] ; |
| wire \user_io_in[14] ; |
| wire \user_io_in[15] ; |
| wire \user_io_in[16] ; |
| wire \user_io_in[17] ; |
| wire \user_io_in[18] ; |
| wire \user_io_in[19] ; |
| wire \user_io_in[1] ; |
| wire \user_io_in[20] ; |
| wire \user_io_in[21] ; |
| wire \user_io_in[22] ; |
| wire \user_io_in[23] ; |
| wire \user_io_in[24] ; |
| wire \user_io_in[25] ; |
| wire \user_io_in[26] ; |
| wire \user_io_in[2] ; |
| wire \user_io_in[3] ; |
| wire \user_io_in[4] ; |
| wire \user_io_in[5] ; |
| wire \user_io_in[6] ; |
| wire \user_io_in[7] ; |
| wire \user_io_in[8] ; |
| wire \user_io_in[9] ; |
| wire \user_io_in_3v3[0] ; |
| wire \user_io_in_3v3[10] ; |
| wire \user_io_in_3v3[11] ; |
| wire \user_io_in_3v3[12] ; |
| wire \user_io_in_3v3[13] ; |
| wire \user_io_in_3v3[14] ; |
| wire \user_io_in_3v3[15] ; |
| wire \user_io_in_3v3[16] ; |
| wire \user_io_in_3v3[17] ; |
| wire \user_io_in_3v3[18] ; |
| wire \user_io_in_3v3[19] ; |
| wire \user_io_in_3v3[1] ; |
| wire \user_io_in_3v3[20] ; |
| wire \user_io_in_3v3[21] ; |
| wire \user_io_in_3v3[22] ; |
| wire \user_io_in_3v3[23] ; |
| wire \user_io_in_3v3[24] ; |
| wire \user_io_in_3v3[25] ; |
| wire \user_io_in_3v3[26] ; |
| wire \user_io_in_3v3[2] ; |
| wire \user_io_in_3v3[3] ; |
| wire \user_io_in_3v3[4] ; |
| wire \user_io_in_3v3[5] ; |
| wire \user_io_in_3v3[6] ; |
| wire \user_io_in_3v3[7] ; |
| wire \user_io_in_3v3[8] ; |
| wire \user_io_in_3v3[9] ; |
| wire \user_io_oeb[0] ; |
| wire \user_io_oeb[10] ; |
| wire \user_io_oeb[11] ; |
| wire \user_io_oeb[12] ; |
| wire \user_io_oeb[13] ; |
| wire \user_io_oeb[14] ; |
| wire \user_io_oeb[15] ; |
| wire \user_io_oeb[16] ; |
| wire \user_io_oeb[17] ; |
| wire \user_io_oeb[18] ; |
| wire \user_io_oeb[19] ; |
| wire \user_io_oeb[1] ; |
| wire \user_io_oeb[20] ; |
| wire \user_io_oeb[21] ; |
| wire \user_io_oeb[22] ; |
| wire \user_io_oeb[23] ; |
| wire \user_io_oeb[24] ; |
| wire \user_io_oeb[25] ; |
| wire \user_io_oeb[26] ; |
| wire \user_io_oeb[2] ; |
| wire \user_io_oeb[3] ; |
| wire \user_io_oeb[4] ; |
| wire \user_io_oeb[5] ; |
| wire \user_io_oeb[6] ; |
| wire \user_io_oeb[7] ; |
| wire \user_io_oeb[8] ; |
| wire \user_io_oeb[9] ; |
| wire \user_io_out[0] ; |
| wire \user_io_out[10] ; |
| wire \user_io_out[11] ; |
| wire \user_io_out[12] ; |
| wire \user_io_out[13] ; |
| wire \user_io_out[14] ; |
| wire \user_io_out[15] ; |
| wire \user_io_out[16] ; |
| wire \user_io_out[17] ; |
| wire \user_io_out[18] ; |
| wire \user_io_out[19] ; |
| wire \user_io_out[1] ; |
| wire \user_io_out[20] ; |
| wire \user_io_out[21] ; |
| wire \user_io_out[22] ; |
| wire \user_io_out[23] ; |
| wire \user_io_out[24] ; |
| wire \user_io_out[25] ; |
| wire \user_io_out[26] ; |
| wire \user_io_out[2] ; |
| wire \user_io_out[3] ; |
| wire \user_io_out[4] ; |
| wire \user_io_out[5] ; |
| wire \user_io_out[6] ; |
| wire \user_io_out[7] ; |
| wire \user_io_out[8] ; |
| wire \user_io_out[9] ; |
| wire \user_irq[0] ; |
| wire \user_irq[1] ; |
| wire \user_irq[2] ; |
| wire \user_irq_core[0] ; |
| wire \user_irq_core[1] ; |
| wire \user_irq_core[2] ; |
| wire \user_irq_ena[0] ; |
| wire \user_irq_ena[1] ; |
| wire \user_irq_ena[2] ; |
| inout vccd; |
| inout vccd1; |
| wire vccd1_core; |
| inout vccd2; |
| wire vccd2_core; |
| wire vccd_core; |
| inout vdda; |
| inout vdda1; |
| inout vdda1_2; |
| wire vdda1_core; |
| inout vdda2; |
| wire vdda2_core; |
| wire vdda_core; |
| inout vddio; |
| inout vddio_2; |
| wire vddio_core; |
| inout vssa; |
| inout vssa1; |
| inout vssa1_2; |
| wire vssa1_core; |
| inout vssa2; |
| wire vssa2_core; |
| wire vssa_core; |
| inout vssd; |
| inout vssd1; |
| wire vssd1_core; |
| inout vssd2; |
| wire vssd2_core; |
| wire vssd_core; |
| inout vssio; |
| inout vssio_2; |
| wire vssio_core; |
| gpio_control_block \gpio_control_bidir_1[0] ( |
| .mgmt_gpio_in(\mgmt_io_in[0] ), |
| .mgmt_gpio_oeb(jtag_outenb), |
| .mgmt_gpio_out(jtag_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[0] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[0] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[0] ), |
| .pad_gpio_dm({ \mprj_io_dm[2] , \mprj_io_dm[1] , \mprj_io_dm[0] }), |
| .pad_gpio_holdover(\mprj_io_holdover[0] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[0] ), |
| .pad_gpio_in(\mprj_io_in[0] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[0] ), |
| .pad_gpio_out(\mprj_io_out[0] ), |
| .pad_gpio_outenb(\mprj_io_oeb[0] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[0] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[0] ), |
| .resetn(\gpio_resetn_1_shifted[0] ), |
| .resetn_out(\gpio_resetn_1[0] ), |
| .serial_clock(\gpio_clock_1_shifted[0] ), |
| .serial_clock_out(\gpio_clock_1[0] ), |
| .serial_data_in(\gpio_serial_link_1_shifted[0] ), |
| .serial_data_out(\gpio_serial_link_1[0] ), |
| .user_gpio_in(\user_io_in[0] ), |
| .user_gpio_oeb(\user_io_oeb[0] ), |
| .user_gpio_out(\user_io_out[0] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_bidir_1[1] ( |
| .mgmt_gpio_in(\mgmt_io_in[1] ), |
| .mgmt_gpio_oeb(sdo_outenb), |
| .mgmt_gpio_out(sdo_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[1] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[1] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[1] ), |
| .pad_gpio_dm({ \mprj_io_dm[5] , \mprj_io_dm[4] , \mprj_io_dm[3] }), |
| .pad_gpio_holdover(\mprj_io_holdover[1] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[1] ), |
| .pad_gpio_in(\mprj_io_in[1] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[1] ), |
| .pad_gpio_out(\mprj_io_out[1] ), |
| .pad_gpio_outenb(\mprj_io_oeb[1] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[1] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[1] ), |
| .resetn(\gpio_resetn_1[0] ), |
| .resetn_out(\gpio_resetn_1[1] ), |
| .serial_clock(\gpio_clock_1[0] ), |
| .serial_clock_out(\gpio_clock_1[1] ), |
| .serial_data_in(\gpio_serial_link_1[0] ), |
| .serial_data_out(\gpio_serial_link_1[1] ), |
| .user_gpio_in(\user_io_in[1] ), |
| .user_gpio_oeb(\user_io_oeb[1] ), |
| .user_gpio_out(\user_io_out[1] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_bidir_2[0] ( |
| .mgmt_gpio_in(\mgmt_io_in[36] ), |
| .mgmt_gpio_oeb(flash_io2_oeb_core), |
| .mgmt_gpio_out(gpio_flash_io2_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[25] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[25] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[25] ), |
| .pad_gpio_dm({ \mprj_io_dm[77] , \mprj_io_dm[76] , \mprj_io_dm[75] }), |
| .pad_gpio_holdover(\mprj_io_holdover[25] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[25] ), |
| .pad_gpio_in(\mprj_io_in[25] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[25] ), |
| .pad_gpio_out(\mprj_io_out[25] ), |
| .pad_gpio_outenb(\mprj_io_oeb[25] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[25] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[25] ), |
| .resetn(\gpio_resetn_1[10] ), |
| .resetn_out(\gpio_resetn_1[11] ), |
| .serial_clock(\gpio_clock_1[10] ), |
| .serial_clock_out(\gpio_clock_1[11] ), |
| .serial_data_in(\gpio_serial_link_2[12] ), |
| .serial_data_out(\gpio_serial_link_2[11] ), |
| .user_gpio_in(\user_io_in[25] ), |
| .user_gpio_oeb(\user_io_oeb[25] ), |
| .user_gpio_out(\user_io_out[25] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_bidir_2[1] ( |
| .mgmt_gpio_in(\mgmt_io_in[37] ), |
| .mgmt_gpio_oeb(flash_io3_oeb_core), |
| .mgmt_gpio_out(gpio_flash_io3_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[26] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[26] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[26] ), |
| .pad_gpio_dm({ \mprj_io_dm[80] , \mprj_io_dm[79] , \mprj_io_dm[78] }), |
| .pad_gpio_holdover(\mprj_io_holdover[26] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[26] ), |
| .pad_gpio_in(\mprj_io_in[26] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[26] ), |
| .pad_gpio_out(\mprj_io_out[26] ), |
| .pad_gpio_outenb(\mprj_io_oeb[26] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[26] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[26] ), |
| .resetn(\gpio_resetn_1[11] ), |
| .resetn_out(\gpio_resetn_1[12] ), |
| .serial_clock(\gpio_clock_1[11] ), |
| .serial_clock_out(\gpio_clock_1[12] ), |
| .serial_data_in(\gpio_serial_link_2_shifted[12] ), |
| .serial_data_out(\gpio_serial_link_2[12] ), |
| .user_gpio_in(\user_io_in[26] ), |
| .user_gpio_oeb(\user_io_oeb[26] ), |
| .user_gpio_out(\user_io_out[26] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[0] ( |
| .mgmt_gpio_in(\mgmt_io_in[2] ), |
| .mgmt_gpio_oeb(\one_loop1[0] ), |
| .mgmt_gpio_out(\mgmt_io_in[2] ), |
| .one(\one_loop1[0] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[2] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[2] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[2] ), |
| .pad_gpio_dm({ \mprj_io_dm[8] , \mprj_io_dm[7] , \mprj_io_dm[6] }), |
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| .vccd1(vccd1_core), |
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| .vssd1(vssd1_core), |
| .zero() |
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| gpio_control_block \gpio_control_in_1[10] ( |
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| .vccd1(vccd1_core), |
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| .vssd1(vssd1_core), |
| .zero() |
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| gpio_control_block \gpio_control_in_1[11] ( |
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| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
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| .vssd1(vssd1_core), |
| .zero() |
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| gpio_control_block \gpio_control_in_1[3] ( |
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| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[4] ( |
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| .user_gpio_out(\user_io_out[6] ), |
| .vccd(vccd_core), |
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| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[5] ( |
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| .user_gpio_out(\user_io_out[7] ), |
| .vccd(vccd_core), |
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| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[6] ( |
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| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[7] ( |
| .mgmt_gpio_in(\mgmt_io_in[9] ), |
| .mgmt_gpio_oeb(\one_loop1[7] ), |
| .mgmt_gpio_out(\mgmt_io_in[9] ), |
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| .serial_data_in(\gpio_serial_link_1[8] ), |
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| .user_gpio_in(\user_io_in[9] ), |
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| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[8] ( |
| .mgmt_gpio_in(\mgmt_io_in[10] ), |
| .mgmt_gpio_oeb(\one_loop1[8] ), |
| .mgmt_gpio_out(\mgmt_io_in[10] ), |
| .one(\one_loop1[8] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[10] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[10] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[10] ), |
| .pad_gpio_dm({ \mprj_io_dm[32] , \mprj_io_dm[31] , \mprj_io_dm[30] }), |
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| .pad_gpio_in(\mprj_io_in[10] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[10] ), |
| .pad_gpio_out(\mprj_io_out[10] ), |
| .pad_gpio_outenb(\mprj_io_oeb[10] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[10] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[10] ), |
| .resetn(\gpio_resetn_1[9] ), |
| .resetn_out(\gpio_resetn_1[10] ), |
| .serial_clock(\gpio_clock_1[9] ), |
| .serial_clock_out(\gpio_clock_1[10] ), |
| .serial_data_in(\gpio_serial_link_1[9] ), |
| .serial_data_out(\gpio_serial_link_1[10] ), |
| .user_gpio_in(\user_io_in[10] ), |
| .user_gpio_oeb(\user_io_oeb[10] ), |
| .user_gpio_out(\user_io_out[10] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[9] ( |
| .mgmt_gpio_in(\mgmt_io_in[11] ), |
| .mgmt_gpio_oeb(\one_loop1[9] ), |
| .mgmt_gpio_out(\mgmt_io_in[11] ), |
| .one(\one_loop1[9] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[11] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[11] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[11] ), |
| .pad_gpio_dm({ \mprj_io_dm[35] , \mprj_io_dm[34] , \mprj_io_dm[33] }), |
| .pad_gpio_holdover(\mprj_io_holdover[11] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[11] ), |
| .pad_gpio_in(\mprj_io_in[11] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[11] ), |
| .pad_gpio_out(\mprj_io_out[11] ), |
| .pad_gpio_outenb(\mprj_io_oeb[11] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[11] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[11] ), |
| .resetn(\gpio_resetn_1[10] ), |
| .resetn_out(\gpio_resetn_1[11] ), |
| .serial_clock(\gpio_clock_1[10] ), |
| .serial_clock_out(\gpio_clock_1[11] ), |
| .serial_data_in(\gpio_serial_link_1[10] ), |
| .serial_data_out(\gpio_serial_link_1[11] ), |
| .user_gpio_in(\user_io_in[11] ), |
| .user_gpio_oeb(\user_io_oeb[11] ), |
| .user_gpio_out(\user_io_out[11] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[0] ( |
| .mgmt_gpio_in(\mgmt_io_in[25] ), |
| .mgmt_gpio_oeb(\one_loop2[0] ), |
| .mgmt_gpio_out(\mgmt_io_in[25] ), |
| .one(\one_loop2[0] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[14] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[14] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[14] ), |
| .pad_gpio_dm({ \mprj_io_dm[44] , \mprj_io_dm[43] , \mprj_io_dm[42] }), |
| .pad_gpio_holdover(\mprj_io_holdover[14] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[14] ), |
| .pad_gpio_in(\mprj_io_in[14] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[14] ), |
| .pad_gpio_out(\mprj_io_out[14] ), |
| .pad_gpio_outenb(\mprj_io_oeb[14] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[14] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[14] ), |
| .resetn(\gpio_resetn_1_shifted[0] ), |
| .resetn_out(\gpio_resetn_1[0] ), |
| .serial_clock(\gpio_clock_1_shifted[0] ), |
| .serial_clock_out(\gpio_clock_1[0] ), |
| .serial_data_in(\gpio_serial_link_2[1] ), |
| .serial_data_out(\gpio_serial_link_2[0] ), |
| .user_gpio_in(\user_io_in[14] ), |
| .user_gpio_oeb(\user_io_oeb[14] ), |
| .user_gpio_out(\user_io_out[14] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[10] ( |
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| .mgmt_gpio_out(\mgmt_io_in[35] ), |
| .one(\one_loop2[10] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[24] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[24] ), |
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| .pad_gpio_dm({ \mprj_io_dm[74] , \mprj_io_dm[73] , \mprj_io_dm[72] }), |
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| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[24] ), |
| .pad_gpio_in(\mprj_io_in[24] ), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[24] ), |
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| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[1] ( |
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| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[2] ( |
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| .vssd1(vssd1_core), |
| .zero() |
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| gpio_control_block \gpio_control_in_2[3] ( |
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| .vssd1(vssd1_core), |
| .zero() |
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| gpio_control_block \gpio_control_in_2[4] ( |
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| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
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| .vssd1(vssd1_core), |
| .zero() |
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| gpio_control_block \gpio_control_in_2[5] ( |
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| .user_gpio_oeb(\user_io_oeb[19] ), |
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| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[6] ( |
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| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[7] ( |
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| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[8] ( |
| .mgmt_gpio_in(\mgmt_io_in[33] ), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[22] ), |
| .resetn(\gpio_resetn_1[7] ), |
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| .serial_clock(\gpio_clock_1[7] ), |
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| .serial_data_in(\gpio_serial_link_2[9] ), |
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| .user_gpio_oeb(\user_io_oeb[22] ), |
| .user_gpio_out(\user_io_out[22] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[9] ( |
| .mgmt_gpio_in(\mgmt_io_in[34] ), |
| .mgmt_gpio_oeb(\one_loop2[9] ), |
| .mgmt_gpio_out(\mgmt_io_in[34] ), |
| .one(\one_loop2[9] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[23] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[23] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[23] ), |
| .pad_gpio_dm({ \mprj_io_dm[71] , \mprj_io_dm[70] , \mprj_io_dm[69] }), |
| .pad_gpio_holdover(\mprj_io_holdover[23] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[23] ), |
| .pad_gpio_in(\mprj_io_in[23] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[23] ), |
| .pad_gpio_out(\mprj_io_out[23] ), |
| .pad_gpio_outenb(\mprj_io_oeb[23] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[23] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[23] ), |
| .resetn(\gpio_resetn_1[8] ), |
| .resetn_out(\gpio_resetn_1[9] ), |
| .serial_clock(\gpio_clock_1[8] ), |
| .serial_clock_out(\gpio_clock_1[9] ), |
| .serial_data_in(\gpio_serial_link_2[10] ), |
| .serial_data_out(\gpio_serial_link_2[9] ), |
| .user_gpio_in(\user_io_in[23] ), |
| .user_gpio_oeb(\user_io_oeb[23] ), |
| .user_gpio_out(\user_io_out[23] ), |
| .vccd(vccd_core), |
| .vccd1(vccd1_core), |
| .vssd(vssd_core), |
| .vssd1(vssd1_core), |
| .zero() |
| ); |
| mgmt_protect mgmt_buffers ( |
| .caravel_clk(caravel_clk), |
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| ); |
| simple_por por ( |
| .por_l(por_l), |
| .porb_h(porb_h), |
| .porb_l(porb_l), |
| .vdd1v8(vccd_core), |
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| .vss(vssio_core) |
| ); |
| sky130_fd_sc_hvl__lsbufhv2lv_1_wrapped rstb_level ( |
| .A(rstb_h), |
| .LVPWR(vccd_core), |
| .VGND(vssio_core), |
| .VPWR(vddio_core), |
| .X(rstb_l) |
| ); |
| mgmt_core soc ( |
| .VGND(vssd_core), |
| .VPWR(vccd_core), |
| .clock(clock_core), |
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| .core_rstn(caravel_rstn), |
| .flash_clk(flash_clk_core), |
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| .flash_io0_di(flash_io0_di_core), |
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| assign \gpio_serial_link_1_shifted[2] = \gpio_serial_link_1[1] ; |
| assign \gpio_serial_link_1_shifted[1] = \gpio_serial_link_1[0] ; |
| assign \user_io_in_3v3[26] = \mprj_io_in_3v3[26] ; |
| assign \user_io_in_3v3[25] = \mprj_io_in_3v3[25] ; |
| assign \user_io_in_3v3[24] = \mprj_io_in_3v3[24] ; |
| assign \user_io_in_3v3[23] = \mprj_io_in_3v3[23] ; |
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| assign mprj_io_loader_data_2 = \gpio_serial_link_2_shifted[12] ; |
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| assign mprj_io_loader_resetn = \gpio_resetn_1_shifted[0] ; |
| endmodule |
