| /* Generated by Yosys 0.9+3621 (git sha1 84e9fa7, gcc 8.3.1 -fPIC -Os) */ |
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| module caravan(vddio, vssio, vdda, vssa, vccd, vssd, vdda1, vdda2, vssa1, vssa2, vccd1, vccd2, vssd1, vssd2, gpio, mprj_io, pwr_ctrl_out, clock, resetb, flash_csb, flash_clk, flash_io0, flash_io1); |
| wire caravel_clk; |
| wire caravel_clk2; |
| wire caravel_rstn; |
| input clock; |
| wire clock_core; |
| output flash_clk; |
| wire flash_clk_core; |
| wire flash_clk_ieb_core; |
| wire flash_clk_oeb_core; |
| output flash_csb; |
| wire flash_csb_core; |
| wire flash_csb_ieb_core; |
| wire flash_csb_oeb_core; |
| output flash_io0; |
| wire flash_io0_di_core; |
| wire flash_io0_do_core; |
| wire flash_io0_ieb_core; |
| wire flash_io0_oeb_core; |
| output flash_io1; |
| wire flash_io1_di_core; |
| wire flash_io1_do_core; |
| wire flash_io1_ieb_core; |
| wire flash_io1_oeb_core; |
| wire flash_io2_do_core; |
| wire flash_io2_oeb_core; |
| wire flash_io3_do_core; |
| wire flash_io3_oeb_core; |
| inout gpio; |
| wire \gpio_clock_1[0] ; |
| wire \gpio_clock_1[10] ; |
| wire \gpio_clock_1[11] ; |
| wire \gpio_clock_1[12] ; |
| wire \gpio_clock_1[13] ; |
| wire \gpio_clock_1[14] ; |
| wire \gpio_clock_1[15] ; |
| wire \gpio_clock_1[16] ; |
| wire \gpio_clock_1[17] ; |
| wire \gpio_clock_1[18] ; |
| wire \gpio_clock_1[1] ; |
| wire \gpio_clock_1[2] ; |
| wire \gpio_clock_1[3] ; |
| wire \gpio_clock_1[4] ; |
| wire \gpio_clock_1[5] ; |
| wire \gpio_clock_1[6] ; |
| wire \gpio_clock_1[7] ; |
| wire \gpio_clock_1[8] ; |
| wire \gpio_clock_1[9] ; |
| wire \gpio_clock_1_shifted[0] ; |
| wire \gpio_clock_1_shifted[10] ; |
| wire \gpio_clock_1_shifted[11] ; |
| wire \gpio_clock_1_shifted[12] ; |
| wire \gpio_clock_1_shifted[13] ; |
| wire \gpio_clock_1_shifted[14] ; |
| wire \gpio_clock_1_shifted[15] ; |
| wire \gpio_clock_1_shifted[16] ; |
| wire \gpio_clock_1_shifted[17] ; |
| wire \gpio_clock_1_shifted[18] ; |
| wire \gpio_clock_1_shifted[1] ; |
| wire \gpio_clock_1_shifted[2] ; |
| wire \gpio_clock_1_shifted[3] ; |
| wire \gpio_clock_1_shifted[4] ; |
| wire \gpio_clock_1_shifted[5] ; |
| wire \gpio_clock_1_shifted[6] ; |
| wire \gpio_clock_1_shifted[7] ; |
| wire \gpio_clock_1_shifted[8] ; |
| wire \gpio_clock_1_shifted[9] ; |
| wire \gpio_clock_2[0] ; |
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| wire \gpio_clock_2[9] ; |
| wire \gpio_clock_2_shifted[0] ; |
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| wire \gpio_clock_2_shifted[18] ; |
| wire \gpio_clock_2_shifted[1] ; |
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| wire \gpio_clock_2_shifted[3] ; |
| wire \gpio_clock_2_shifted[4] ; |
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| wire \gpio_clock_2_shifted[6] ; |
| wire \gpio_clock_2_shifted[7] ; |
| wire \gpio_clock_2_shifted[8] ; |
| wire \gpio_clock_2_shifted[9] ; |
| wire gpio_flash_io2_out; |
| wire gpio_flash_io3_out; |
| wire gpio_in_core; |
| wire gpio_inenb_core; |
| wire gpio_mode0_core; |
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| wire gpio_out_core; |
| wire gpio_outenb_core; |
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| wire \gpio_resetn_1[14] ; |
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| wire \gpio_resetn_1[1] ; |
| wire \gpio_resetn_1[2] ; |
| wire \gpio_resetn_1[3] ; |
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| wire \gpio_resetn_1[5] ; |
| wire \gpio_resetn_1[6] ; |
| wire \gpio_resetn_1[7] ; |
| wire \gpio_resetn_1[8] ; |
| wire \gpio_resetn_1[9] ; |
| wire \gpio_resetn_1_shifted[0] ; |
| wire \gpio_resetn_1_shifted[10] ; |
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| wire \gpio_resetn_1_shifted[9] ; |
| wire \gpio_resetn_2[0] ; |
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| wire \gpio_serial_link_1[0] ; |
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| wire por_l; |
| wire porb_h; |
| wire porb_l; |
| output [3:0] pwr_ctrl_out; |
| input resetb; |
| wire rstb_h; |
| wire rstb_l; |
| wire sdo_out; |
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| wire \spi_ro_config_core[0] ; |
| wire \spi_ro_config_core[1] ; |
| wire \spi_ro_config_core[2] ; |
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| wire \spi_ro_config_core[5] ; |
| wire \spi_ro_config_core[6] ; |
| wire \spi_ro_config_core[7] ; |
| wire \user_analog[0] ; |
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| wire \user_irq_ena[0] ; |
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| inout vccd; |
| inout vccd1; |
| inout vccd2; |
| inout vdda; |
| inout vdda1; |
| inout vdda2; |
| inout vddio; |
| inout vssa; |
| inout vssa1; |
| inout vssa2; |
| inout vssd; |
| inout vssd1; |
| inout vssd2; |
| inout vssio; |
| wire xbar_ack_i_core; |
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| wire \xbar_dat_o_core[4] ; |
| wire \xbar_dat_o_core[5] ; |
| wire \xbar_dat_o_core[6] ; |
| wire \xbar_dat_o_core[7] ; |
| wire \xbar_dat_o_core[8] ; |
| wire \xbar_dat_o_core[9] ; |
| wire \xbar_sel_o_core[0] ; |
| wire \xbar_sel_o_core[1] ; |
| wire \xbar_sel_o_core[2] ; |
| wire \xbar_sel_o_core[3] ; |
| wire xbar_stb_o_core; |
| wire xbar_we_o_core; |
| gpio_control_block \gpio_control_bidir_1[0] ( |
| .mgmt_gpio_in(\mgmt_io_in[0] ), |
| .mgmt_gpio_oeb(jtag_outenb), |
| .mgmt_gpio_out(jtag_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[0] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[0] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[0] ), |
| .pad_gpio_dm({ \mprj_io_dm[2] , \mprj_io_dm[1] , \mprj_io_dm[0] }), |
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| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[0] ), |
| .pad_gpio_in(\mprj_io_in[0] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[0] ), |
| .pad_gpio_out(\mprj_io_out[0] ), |
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| .pad_gpio_slow_sel(\mprj_io_slow_sel[0] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[0] ), |
| .resetn(\gpio_resetn_1_shifted[0] ), |
| .resetn_out(\gpio_resetn_1[0] ), |
| .serial_clock(\gpio_clock_1_shifted[0] ), |
| .serial_clock_out(\gpio_clock_1[0] ), |
| .serial_data_in(\gpio_serial_link_1_shifted[0] ), |
| .serial_data_out(\gpio_serial_link_1[0] ), |
| .user_gpio_in(\user_io_in[0] ), |
| .user_gpio_oeb(\user_io_oeb[0] ), |
| .user_gpio_out(\user_io_out[0] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_bidir_1[1] ( |
| .mgmt_gpio_in(\mgmt_io_in[1] ), |
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| .mgmt_gpio_out(sdo_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[1] ), |
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| .pad_gpio_ana_sel(\mprj_io_analog_sel[1] ), |
| .pad_gpio_dm({ \mprj_io_dm[5] , \mprj_io_dm[4] , \mprj_io_dm[3] }), |
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| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[1] ), |
| .pad_gpio_in(\mprj_io_in[1] ), |
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| .pad_gpio_out(\mprj_io_out[1] ), |
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| .pad_gpio_slow_sel(\mprj_io_slow_sel[1] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[1] ), |
| .resetn(\gpio_resetn_1[0] ), |
| .resetn_out(\gpio_resetn_1[1] ), |
| .serial_clock(\gpio_clock_1[0] ), |
| .serial_clock_out(\gpio_clock_1[1] ), |
| .serial_data_in(\gpio_serial_link_1[0] ), |
| .serial_data_out(\gpio_serial_link_1[1] ), |
| .user_gpio_in(\user_io_in[1] ), |
| .user_gpio_oeb(\user_io_oeb[1] ), |
| .user_gpio_out(\user_io_out[1] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_bidir_2[0] ( |
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| .mgmt_gpio_out(gpio_flash_io2_out), |
| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[25] ), |
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| .pad_gpio_dm({ \mprj_io_dm[77] , \mprj_io_dm[76] , \mprj_io_dm[75] }), |
| .pad_gpio_holdover(\mprj_io_holdover[25] ), |
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| .pad_gpio_in(\mprj_io_in[25] ), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[25] ), |
| .resetn(\gpio_resetn_1[10] ), |
| .resetn_out(\gpio_resetn_1[11] ), |
| .serial_clock(\gpio_clock_1[10] ), |
| .serial_clock_out(\gpio_clock_1[11] ), |
| .serial_data_in(\gpio_serial_link_2[12] ), |
| .serial_data_out(\gpio_serial_link_2[11] ), |
| .user_gpio_in(\user_io_in[25] ), |
| .user_gpio_oeb(\user_io_oeb[25] ), |
| .user_gpio_out(\user_io_out[25] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_bidir_2[1] ( |
| .mgmt_gpio_in(\mgmt_io_in[37] ), |
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| .one(), |
| .pad_gpio_ana_en(\mprj_io_analog_en[26] ), |
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| .pad_gpio_dm({ \mprj_io_dm[80] , \mprj_io_dm[79] , \mprj_io_dm[78] }), |
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| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[26] ), |
| .pad_gpio_in(\mprj_io_in[26] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[26] ), |
| .pad_gpio_out(\mprj_io_out[26] ), |
| .pad_gpio_outenb(\mprj_io_oeb[26] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[26] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[26] ), |
| .resetn(\gpio_resetn_1[11] ), |
| .resetn_out(\gpio_resetn_1[12] ), |
| .serial_clock(\gpio_clock_1[11] ), |
| .serial_clock_out(\gpio_clock_1[12] ), |
| .serial_data_in(\gpio_serial_link_2_shifted[12] ), |
| .serial_data_out(\gpio_serial_link_2[12] ), |
| .user_gpio_in(\user_io_in[26] ), |
| .user_gpio_oeb(\user_io_oeb[26] ), |
| .user_gpio_out(\user_io_out[26] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[0] ( |
| .mgmt_gpio_in(\mgmt_io_in[2] ), |
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| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[2] ), |
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| .pad_gpio_slow_sel(\mprj_io_slow_sel[2] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[2] ), |
| .resetn(\gpio_resetn_1[1] ), |
| .resetn_out(\gpio_resetn_1[2] ), |
| .serial_clock(\gpio_clock_1[1] ), |
| .serial_clock_out(\gpio_clock_1[2] ), |
| .serial_data_in(\gpio_serial_link_1[1] ), |
| .serial_data_out(\gpio_serial_link_1[2] ), |
| .user_gpio_in(\user_io_in[2] ), |
| .user_gpio_oeb(\user_io_oeb[2] ), |
| .user_gpio_out(\user_io_out[2] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[10] ( |
| .mgmt_gpio_in(\mgmt_io_in[12] ), |
| .mgmt_gpio_oeb(\one_loop1[10] ), |
| .mgmt_gpio_out(\mgmt_io_in[12] ), |
| .one(\one_loop1[10] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[12] ), |
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| .pad_gpio_ana_sel(\mprj_io_analog_sel[12] ), |
| .pad_gpio_dm({ \mprj_io_dm[38] , \mprj_io_dm[37] , \mprj_io_dm[36] }), |
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| .pad_gpio_slow_sel(\mprj_io_slow_sel[12] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[12] ), |
| .resetn(\gpio_resetn_1[11] ), |
| .resetn_out(\gpio_resetn_1[12] ), |
| .serial_clock(\gpio_clock_1[11] ), |
| .serial_clock_out(\gpio_clock_1[12] ), |
| .serial_data_in(\gpio_serial_link_1[11] ), |
| .serial_data_out(\gpio_serial_link_1[12] ), |
| .user_gpio_in(\user_io_in[12] ), |
| .user_gpio_oeb(\user_io_oeb[12] ), |
| .user_gpio_out(\user_io_out[12] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[11] ( |
| .mgmt_gpio_in(\mgmt_io_in[13] ), |
| .mgmt_gpio_oeb(\one_loop1[11] ), |
| .mgmt_gpio_out(\mgmt_io_in[13] ), |
| .one(\one_loop1[11] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[13] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[13] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[13] ), |
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| .pad_gpio_in(\mprj_io_in[13] ), |
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| .pad_gpio_slow_sel(\mprj_io_slow_sel[13] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[13] ), |
| .resetn(\gpio_resetn_1[12] ), |
| .resetn_out(\gpio_resetn_1[13] ), |
| .serial_clock(\gpio_clock_1[12] ), |
| .serial_clock_out(\gpio_clock_1[13] ), |
| .serial_data_in(\gpio_serial_link_1[12] ), |
| .serial_data_out(\gpio_serial_link_1[13] ), |
| .user_gpio_in(\user_io_in[13] ), |
| .user_gpio_oeb(\user_io_oeb[13] ), |
| .user_gpio_out(\user_io_out[13] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[1] ( |
| .mgmt_gpio_in(\mgmt_io_in[3] ), |
| .mgmt_gpio_oeb(\one_loop1[1] ), |
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| .one(\one_loop1[1] ), |
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| .pad_gpio_in(\mprj_io_in[3] ), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[3] ), |
| .resetn(\gpio_resetn_1[2] ), |
| .resetn_out(\gpio_resetn_1[3] ), |
| .serial_clock(\gpio_clock_1[2] ), |
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| .serial_data_in(\gpio_serial_link_1[2] ), |
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| .user_gpio_in(\user_io_in[3] ), |
| .user_gpio_oeb(\user_io_oeb[3] ), |
| .user_gpio_out(\user_io_out[3] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[2] ( |
| .mgmt_gpio_in(\mgmt_io_in[4] ), |
| .mgmt_gpio_oeb(\one_loop1[2] ), |
| .mgmt_gpio_out(\mgmt_io_in[4] ), |
| .one(\one_loop1[2] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[4] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[4] ), |
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| .pad_gpio_dm({ \mprj_io_dm[14] , \mprj_io_dm[13] , \mprj_io_dm[12] }), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[4] ), |
| .resetn(\gpio_resetn_1[3] ), |
| .resetn_out(\gpio_resetn_1[4] ), |
| .serial_clock(\gpio_clock_1[3] ), |
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| .serial_data_out(\gpio_serial_link_1[4] ), |
| .user_gpio_in(\user_io_in[4] ), |
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| .user_gpio_out(\user_io_out[4] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[3] ( |
| .mgmt_gpio_in(\mgmt_io_in[5] ), |
| .mgmt_gpio_oeb(\one_loop1[3] ), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[5] ), |
| .resetn(\gpio_resetn_1[4] ), |
| .resetn_out(\gpio_resetn_1[5] ), |
| .serial_clock(\gpio_clock_1[4] ), |
| .serial_clock_out(\gpio_clock_1[5] ), |
| .serial_data_in(\gpio_serial_link_1[4] ), |
| .serial_data_out(\gpio_serial_link_1[5] ), |
| .user_gpio_in(\user_io_in[5] ), |
| .user_gpio_oeb(\user_io_oeb[5] ), |
| .user_gpio_out(\user_io_out[5] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[4] ( |
| .mgmt_gpio_in(\mgmt_io_in[6] ), |
| .mgmt_gpio_oeb(\one_loop1[4] ), |
| .mgmt_gpio_out(\mgmt_io_in[6] ), |
| .one(\one_loop1[4] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[6] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[6] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[6] ), |
| .pad_gpio_dm({ \mprj_io_dm[20] , \mprj_io_dm[19] , \mprj_io_dm[18] }), |
| .pad_gpio_holdover(\mprj_io_holdover[6] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[6] ), |
| .pad_gpio_in(\mprj_io_in[6] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[6] ), |
| .pad_gpio_out(\mprj_io_out[6] ), |
| .pad_gpio_outenb(\mprj_io_oeb[6] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[6] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[6] ), |
| .resetn(\gpio_resetn_1[5] ), |
| .resetn_out(\gpio_resetn_1[6] ), |
| .serial_clock(\gpio_clock_1[5] ), |
| .serial_clock_out(\gpio_clock_1[6] ), |
| .serial_data_in(\gpio_serial_link_1[5] ), |
| .serial_data_out(\gpio_serial_link_1[6] ), |
| .user_gpio_in(\user_io_in[6] ), |
| .user_gpio_oeb(\user_io_oeb[6] ), |
| .user_gpio_out(\user_io_out[6] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[5] ( |
| .mgmt_gpio_in(\mgmt_io_in[7] ), |
| .mgmt_gpio_oeb(\one_loop1[5] ), |
| .mgmt_gpio_out(\mgmt_io_in[7] ), |
| .one(\one_loop1[5] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[7] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[7] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[7] ), |
| .pad_gpio_dm({ \mprj_io_dm[23] , \mprj_io_dm[22] , \mprj_io_dm[21] }), |
| .pad_gpio_holdover(\mprj_io_holdover[7] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[7] ), |
| .pad_gpio_in(\mprj_io_in[7] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[7] ), |
| .pad_gpio_out(\mprj_io_out[7] ), |
| .pad_gpio_outenb(\mprj_io_oeb[7] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[7] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[7] ), |
| .resetn(\gpio_resetn_1[6] ), |
| .resetn_out(\gpio_resetn_1[7] ), |
| .serial_clock(\gpio_clock_1[6] ), |
| .serial_clock_out(\gpio_clock_1[7] ), |
| .serial_data_in(\gpio_serial_link_1[6] ), |
| .serial_data_out(\gpio_serial_link_1[7] ), |
| .user_gpio_in(\user_io_in[7] ), |
| .user_gpio_oeb(\user_io_oeb[7] ), |
| .user_gpio_out(\user_io_out[7] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_1[6] ( |
| .mgmt_gpio_in(\mgmt_io_in[8] ), |
| .mgmt_gpio_oeb(\one_loop1[6] ), |
| .mgmt_gpio_out(\mgmt_io_in[8] ), |
| .one(\one_loop1[6] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[8] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[8] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[8] ), |
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| .zero() |
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| gpio_control_block \gpio_control_in_1[7] ( |
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| gpio_control_block \gpio_control_in_1[8] ( |
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| .zero() |
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| gpio_control_block \gpio_control_in_2[1] ( |
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| .vccd(vccd), |
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| .vssd1(vssd1), |
| .zero() |
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| gpio_control_block \gpio_control_in_2[2] ( |
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| .user_gpio_oeb(\user_io_oeb[16] ), |
| .user_gpio_out(\user_io_out[16] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[3] ( |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[17] ), |
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| .serial_data_out(\gpio_serial_link_2[3] ), |
| .user_gpio_in(\user_io_in[17] ), |
| .user_gpio_oeb(\user_io_oeb[17] ), |
| .user_gpio_out(\user_io_out[17] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[4] ( |
| .mgmt_gpio_in(\mgmt_io_in[29] ), |
| .mgmt_gpio_oeb(\one_loop2[4] ), |
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| .pad_gpio_outenb(\mprj_io_oeb[18] ), |
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| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[18] ), |
| .resetn(\gpio_resetn_1[3] ), |
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| .user_gpio_oeb(\user_io_oeb[18] ), |
| .user_gpio_out(\user_io_out[18] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[5] ( |
| .mgmt_gpio_in(\mgmt_io_in[30] ), |
| .mgmt_gpio_oeb(\one_loop2[5] ), |
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| .pad_gpio_ana_sel(\mprj_io_analog_sel[19] ), |
| .pad_gpio_dm({ \mprj_io_dm[59] , \mprj_io_dm[58] , \mprj_io_dm[57] }), |
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| .pad_gpio_in(\mprj_io_in[19] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[19] ), |
| .pad_gpio_out(\mprj_io_out[19] ), |
| .pad_gpio_outenb(\mprj_io_oeb[19] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[19] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[19] ), |
| .resetn(\gpio_resetn_1[4] ), |
| .resetn_out(\gpio_resetn_1[5] ), |
| .serial_clock(\gpio_clock_1[4] ), |
| .serial_clock_out(\gpio_clock_1[5] ), |
| .serial_data_in(\gpio_serial_link_2[6] ), |
| .serial_data_out(\gpio_serial_link_2[5] ), |
| .user_gpio_in(\user_io_in[19] ), |
| .user_gpio_oeb(\user_io_oeb[19] ), |
| .user_gpio_out(\user_io_out[19] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[6] ( |
| .mgmt_gpio_in(\mgmt_io_in[31] ), |
| .mgmt_gpio_oeb(\one_loop2[6] ), |
| .mgmt_gpio_out(\mgmt_io_in[31] ), |
| .one(\one_loop2[6] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[20] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[20] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[20] ), |
| .pad_gpio_dm({ \mprj_io_dm[62] , \mprj_io_dm[61] , \mprj_io_dm[60] }), |
| .pad_gpio_holdover(\mprj_io_holdover[20] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[20] ), |
| .pad_gpio_in(\mprj_io_in[20] ), |
| .pad_gpio_inenb(\mprj_io_inp_dis[20] ), |
| .pad_gpio_out(\mprj_io_out[20] ), |
| .pad_gpio_outenb(\mprj_io_oeb[20] ), |
| .pad_gpio_slow_sel(\mprj_io_slow_sel[20] ), |
| .pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[20] ), |
| .resetn(\gpio_resetn_1[5] ), |
| .resetn_out(\gpio_resetn_1[6] ), |
| .serial_clock(\gpio_clock_1[5] ), |
| .serial_clock_out(\gpio_clock_1[6] ), |
| .serial_data_in(\gpio_serial_link_2[7] ), |
| .serial_data_out(\gpio_serial_link_2[6] ), |
| .user_gpio_in(\user_io_in[20] ), |
| .user_gpio_oeb(\user_io_oeb[20] ), |
| .user_gpio_out(\user_io_out[20] ), |
| .vccd(vccd), |
| .vccd1(vccd1), |
| .vssd(vssd), |
| .vssd1(vssd1), |
| .zero() |
| ); |
| gpio_control_block \gpio_control_in_2[7] ( |
| .mgmt_gpio_in(\mgmt_io_in[32] ), |
| .mgmt_gpio_oeb(\one_loop2[7] ), |
| .mgmt_gpio_out(\mgmt_io_in[32] ), |
| .one(\one_loop2[7] ), |
| .pad_gpio_ana_en(\mprj_io_analog_en[21] ), |
| .pad_gpio_ana_pol(\mprj_io_analog_pol[21] ), |
| .pad_gpio_ana_sel(\mprj_io_analog_sel[21] ), |
| .pad_gpio_dm({ \mprj_io_dm[65] , \mprj_io_dm[64] , \mprj_io_dm[63] }), |
| .pad_gpio_holdover(\mprj_io_holdover[21] ), |
| .pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[21] ), |
| .pad_gpio_in(\mprj_io_in[21] ), |
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| .pad_gpio_out(\mprj_io_out[21] ), |
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| assign \mprj_io_enh[18] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[17] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[16] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[15] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[14] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[13] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[12] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[11] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[10] = \mprj_io_enh[0] ; |
| assign \mprj_io_enh[9] = \mprj_io_enh[0] ; |
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| assign \mprj_io_enh[5] = \mprj_io_enh[0] ; |
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| assign \mprj_io_enh[3] = \mprj_io_enh[0] ; |
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| assign \mprj_io_enh[1] = \mprj_io_enh[0] ; |
| assign \gpio_clock_1_shifted[2] = \gpio_clock_1[1] ; |
| assign \gpio_resetn_1_shifted[18] = 1'b0; |
| assign \gpio_resetn_1_shifted[17] = 1'b0; |
| assign \gpio_resetn_1_shifted[16] = 1'b0; |
| assign \gpio_resetn_1_shifted[15] = 1'b0; |
| assign \gpio_resetn_1_shifted[14] = 1'b0; |
| assign \gpio_resetn_1_shifted[13] = \gpio_resetn_1[12] ; |
| assign \gpio_resetn_1_shifted[12] = \gpio_resetn_1[11] ; |
| assign \gpio_resetn_1_shifted[11] = \gpio_resetn_1[10] ; |
| assign \gpio_resetn_1_shifted[10] = \gpio_resetn_1[9] ; |
| assign \gpio_resetn_1_shifted[9] = \gpio_resetn_1[8] ; |
| assign \gpio_resetn_1_shifted[8] = \gpio_resetn_1[7] ; |
| assign \gpio_clock_1_shifted[3] = \gpio_clock_1[2] ; |
| assign \gpio_clock_2_shifted[18] = 1'b0; |
| assign \gpio_clock_2_shifted[7] = \gpio_clock_2[8] ; |
| assign \gpio_resetn_1_shifted[6] = \gpio_resetn_1[5] ; |
| assign \gpio_clock_2_shifted[6] = \gpio_clock_2[7] ; |
| assign \gpio_clock_2_shifted[17] = 1'b0; |
| assign \gpio_clock_1_shifted[8] = \gpio_clock_1[7] ; |
| assign \gpio_clock_2_shifted[3] = \gpio_clock_2[4] ; |
| assign \gpio_clock_1_shifted[7] = \gpio_clock_1[6] ; |
| assign \gpio_clock_2_shifted[5] = \gpio_clock_2[6] ; |
| assign \gpio_clock_2_shifted[16] = 1'b0; |
| assign \gpio_clock_2_shifted[15] = 1'b0; |
| assign \gpio_clock_2_shifted[14] = 1'b0; |
| assign \gpio_clock_2_shifted[13] = 1'b0; |
| assign \gpio_clock_2_shifted[9] = \gpio_clock_2[10] ; |
| assign \gpio_clock_2_shifted[10] = \gpio_clock_2[11] ; |
| assign porb_h = \mprj_io_enh[0] ; |
| assign \gpio_clock_2_shifted[11] = \gpio_clock_2[12] ; |
| assign \gpio_clock_1_shifted[11] = \gpio_clock_1[10] ; |
| assign mprj_io_loader_data_2 = \gpio_serial_link_2_shifted[12] ; |
| assign mprj_io_loader_data_1 = \gpio_serial_link_1_shifted[0] ; |
| assign mprj_io_loader_clock = \gpio_clock_1_shifted[0] ; |
| assign mprj_io_loader_resetn = \gpio_resetn_1_shifted[0] ; |
| assign \gpio_resetn_1_shifted[4] = \gpio_resetn_1[3] ; |
| assign \gpio_clock_1_shifted[6] = \gpio_clock_1[5] ; |
| assign \gpio_clock_2_shifted[0] = \gpio_clock_2[1] ; |
| assign \gpio_clock_2_shifted[2] = \gpio_clock_2[3] ; |
| assign \gpio_resetn_1_shifted[3] = \gpio_resetn_1[2] ; |
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| assign \gpio_clock_2_shifted[8] = \gpio_clock_2[9] ; |
| assign \gpio_clock_1_shifted[10] = \gpio_clock_1[9] ; |
| assign \gpio_resetn_1_shifted[2] = \gpio_resetn_1[1] ; |
| assign \gpio_clock_1_shifted[15] = 1'b0; |
| assign \gpio_clock_2_shifted[4] = \gpio_clock_2[5] ; |
| assign \gpio_clock_1_shifted[16] = 1'b0; |
| assign \gpio_clock_1_shifted[17] = 1'b0; |
| assign \gpio_resetn_1_shifted[1] = \gpio_resetn_1[0] ; |
| assign \gpio_clock_1_shifted[1] = \gpio_clock_1[0] ; |
| assign \gpio_clock_1_shifted[14] = 1'b0; |
| assign \gpio_clock_1_shifted[4] = \gpio_clock_1[3] ; |
| assign \gpio_clock_1_shifted[12] = \gpio_clock_1[11] ; |
| assign \gpio_resetn_1_shifted[7] = \gpio_resetn_1[6] ; |
| assign \gpio_clock_1_shifted[9] = \gpio_clock_1[8] ; |
| assign \gpio_clock_1_shifted[13] = \gpio_clock_1[12] ; |
| assign \gpio_resetn_1_shifted[5] = \gpio_resetn_1[4] ; |
| assign \gpio_clock_1_shifted[18] = 1'b0; |
| assign \gpio_clock_2_shifted[1] = \gpio_clock_2[2] ; |
| assign \gpio_clock_2_shifted[12] = \gpio_clock_1_shifted[0] ; |
| endmodule |
