add gl
diff --git a/verilog/gl/user_project_wrapper.v b/verilog/gl/user_project_wrapper.v
index ecae883..4e04c7e 100644
--- a/verilog/gl/user_project_wrapper.v
+++ b/verilog/gl/user_project_wrapper.v
@@ -54,14 +54,10 @@
input [3:0] wbs_sel_i;
- user_proj_example mprj (.vccd1(vccd1),
+ wrapped_frequency_counter wrapped_frequency_counter_1 (.active(la_data_in[1]),
+ .vccd1(vccd1),
.vssd1(vssd1),
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- .wb_rst_i(wb_rst_i),
- .wbs_ack_o(wbs_ack_o),
- .wbs_cyc_i(wbs_cyc_i),
- .wbs_stb_i(wbs_stb_i),
- .wbs_we_i(wbs_we_i),
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@@ -176,74 +172,7 @@
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@@ -274,104 +203,8 @@
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- la_data_out[105],
- la_data_out[104],
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- la_data_out[100],
- la_data_out[99],
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- la_data_out[78],
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- la_data_out[76],
- la_data_out[75],
- la_data_out[74],
- la_data_out[73],
- la_data_out[72],
- la_data_out[71],
- la_data_out[70],
- la_data_out[69],
- la_data_out[68],
- la_data_out[67],
- la_data_out[66],
- la_data_out[65],
- la_data_out[64],
- la_data_out[63],
+ la_data_in[32]}),
+ .la1_data_out({la_data_out[63],
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@@ -402,104 +235,8 @@
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la_data_out[33],
- la_data_out[32],
- la_data_out[31],
- la_data_out[30],
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- la_oenb[126],
- la_oenb[125],
- la_oenb[124],
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+ la_data_out[32]}),
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@@ -530,137 +267,3215 @@
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+ la_data_out[50],
+ la_data_out[49],
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+ la_data_out[47],
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+ la_data_out[32]}),
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+ la_oenb[37],
+ la_oenb[36],
+ la_oenb[35],
+ la_oenb[34],
+ la_oenb[33],
+ la_oenb[32]}));
+ wrapped_frequency_counter wrapped_frequency_counter_13 (.active(la_data_in[13]),
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