blob: 50595d7498869a0c274b3e4878c606f1cf88ed91 [file] [log] [blame]
/* Generated by Yosys 0.9+4052 (git sha1 d061b0e, gcc 8.3.1 -fPIC -Os) */
module caravan(vddio, vddio_2, vssio, vssio_2, vdda, vssa, vccd, vssd, vdda1, vdda1_2, vdda2, vssa1, vssa1_2, vssa2, vccd1, vccd2, vssd1, vssd2, gpio, mprj_io, clock, resetb, flash_csb, flash_clk, flash_io0, flash_io1);
wire caravel_clk;
wire caravel_clk2;
wire caravel_clk_buf;
wire caravel_rstn;
wire caravel_rstn_buf;
wire clk_passthru;
input clock;
wire clock_core;
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wire debug_in;
wire debug_mode;
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wire debug_out;
wire ext_clk_sel;
wire ext_reset;
output flash_clk;
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wire flash_clk_frame;
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wire flash_clk_oeb;
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output flash_csb;
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output flash_io0;
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wire flash_io0_do;
wire flash_io0_do_buf;
wire flash_io0_do_core;
wire flash_io0_ieb;
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wire flash_io0_ieb_core;
wire flash_io0_oeb;
wire flash_io0_oeb_buf;
wire flash_io0_oeb_core;
output flash_io1;
wire flash_io1_di;
wire flash_io1_di_buf;
wire flash_io1_di_core;
wire flash_io1_do;
wire flash_io1_do_buf;
wire flash_io1_do_core;
wire flash_io1_ieb;
wire flash_io1_ieb_buf;
wire flash_io1_ieb_core;
wire flash_io1_oeb;
wire flash_io1_oeb_buf;
wire flash_io1_oeb_core;
wire flash_io2_di_core;
wire flash_io2_do_core;
wire flash_io2_ieb_core;
wire flash_io2_oeb_core;
wire flash_io3_di_core;
wire flash_io3_do_core;
wire flash_io3_ieb_core;
wire flash_io3_oeb_core;
inout gpio;
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wire \spare_xz_nc[78] ;
wire \spare_xz_nc[79] ;
wire \spare_xz_nc[7] ;
wire \spare_xz_nc[80] ;
wire \spare_xz_nc[81] ;
wire \spare_xz_nc[82] ;
wire \spare_xz_nc[83] ;
wire \spare_xz_nc[84] ;
wire \spare_xz_nc[85] ;
wire \spare_xz_nc[86] ;
wire \spare_xz_nc[87] ;
wire \spare_xz_nc[88] ;
wire \spare_xz_nc[89] ;
wire \spare_xz_nc[8] ;
wire \spare_xz_nc[90] ;
wire \spare_xz_nc[91] ;
wire \spare_xz_nc[92] ;
wire \spare_xz_nc[93] ;
wire \spare_xz_nc[94] ;
wire \spare_xz_nc[95] ;
wire \spare_xz_nc[96] ;
wire \spare_xz_nc[97] ;
wire \spare_xz_nc[98] ;
wire \spare_xz_nc[99] ;
wire \spare_xz_nc[9] ;
wire spi_csb;
wire spi_enabled;
wire \spi_pll90_sel[0] ;
wire \spi_pll90_sel[1] ;
wire \spi_pll90_sel[2] ;
wire spi_pll_dco_ena;
wire \spi_pll_div[0] ;
wire \spi_pll_div[1] ;
wire \spi_pll_div[2] ;
wire \spi_pll_div[3] ;
wire \spi_pll_div[4] ;
wire spi_pll_ena;
wire \spi_pll_sel[0] ;
wire \spi_pll_sel[1] ;
wire \spi_pll_sel[2] ;
wire \spi_pll_trim[0] ;
wire \spi_pll_trim[10] ;
wire \spi_pll_trim[11] ;
wire \spi_pll_trim[12] ;
wire \spi_pll_trim[13] ;
wire \spi_pll_trim[14] ;
wire \spi_pll_trim[15] ;
wire \spi_pll_trim[16] ;
wire \spi_pll_trim[17] ;
wire \spi_pll_trim[18] ;
wire \spi_pll_trim[19] ;
wire \spi_pll_trim[1] ;
wire \spi_pll_trim[20] ;
wire \spi_pll_trim[21] ;
wire \spi_pll_trim[22] ;
wire \spi_pll_trim[23] ;
wire \spi_pll_trim[24] ;
wire \spi_pll_trim[25] ;
wire \spi_pll_trim[2] ;
wire \spi_pll_trim[3] ;
wire \spi_pll_trim[4] ;
wire \spi_pll_trim[5] ;
wire \spi_pll_trim[6] ;
wire \spi_pll_trim[7] ;
wire \spi_pll_trim[8] ;
wire \spi_pll_trim[9] ;
wire \spi_ro_config_core[0] ;
wire \spi_ro_config_core[1] ;
wire \spi_ro_config_core[2] ;
wire \spi_ro_config_core[3] ;
wire \spi_ro_config_core[4] ;
wire \spi_ro_config_core[5] ;
wire \spi_ro_config_core[6] ;
wire \spi_ro_config_core[7] ;
wire spi_sck;
wire spi_sdi;
wire spi_sdo;
wire spi_sdoenb;
wire trap;
wire uart_enabled;
wire \user_analog[0] ;
wire \user_analog[10] ;
wire \user_analog[1] ;
wire \user_analog[2] ;
wire \user_analog[3] ;
wire \user_analog[4] ;
wire \user_analog[5] ;
wire \user_analog[6] ;
wire \user_analog[7] ;
wire \user_analog[8] ;
wire \user_analog[9] ;
wire \user_clamp_high[0] ;
wire \user_clamp_high[1] ;
wire \user_clamp_high[2] ;
wire \user_clamp_low[0] ;
wire \user_clamp_low[1] ;
wire \user_clamp_low[2] ;
wire \user_gpio_analog[0] ;
wire \user_gpio_analog[10] ;
wire \user_gpio_analog[11] ;
wire \user_gpio_analog[12] ;
wire \user_gpio_analog[13] ;
wire \user_gpio_analog[14] ;
wire \user_gpio_analog[15] ;
wire \user_gpio_analog[16] ;
wire \user_gpio_analog[17] ;
wire \user_gpio_analog[1] ;
wire \user_gpio_analog[2] ;
wire \user_gpio_analog[3] ;
wire \user_gpio_analog[4] ;
wire \user_gpio_analog[5] ;
wire \user_gpio_analog[6] ;
wire \user_gpio_analog[7] ;
wire \user_gpio_analog[8] ;
wire \user_gpio_analog[9] ;
wire \user_gpio_noesd[0] ;
wire \user_gpio_noesd[10] ;
wire \user_gpio_noesd[11] ;
wire \user_gpio_noesd[12] ;
wire \user_gpio_noesd[13] ;
wire \user_gpio_noesd[14] ;
wire \user_gpio_noesd[15] ;
wire \user_gpio_noesd[16] ;
wire \user_gpio_noesd[17] ;
wire \user_gpio_noesd[1] ;
wire \user_gpio_noesd[2] ;
wire \user_gpio_noesd[3] ;
wire \user_gpio_noesd[4] ;
wire \user_gpio_noesd[5] ;
wire \user_gpio_noesd[6] ;
wire \user_gpio_noesd[7] ;
wire \user_gpio_noesd[8] ;
wire \user_gpio_noesd[9] ;
wire \user_io_in[0] ;
wire \user_io_in[10] ;
wire \user_io_in[11] ;
wire \user_io_in[12] ;
wire \user_io_in[13] ;
wire \user_io_in[14] ;
wire \user_io_in[15] ;
wire \user_io_in[16] ;
wire \user_io_in[17] ;
wire \user_io_in[18] ;
wire \user_io_in[19] ;
wire \user_io_in[1] ;
wire \user_io_in[20] ;
wire \user_io_in[21] ;
wire \user_io_in[22] ;
wire \user_io_in[23] ;
wire \user_io_in[24] ;
wire \user_io_in[25] ;
wire \user_io_in[26] ;
wire \user_io_in[2] ;
wire \user_io_in[3] ;
wire \user_io_in[4] ;
wire \user_io_in[5] ;
wire \user_io_in[6] ;
wire \user_io_in[7] ;
wire \user_io_in[8] ;
wire \user_io_in[9] ;
wire \user_io_in_3v3[0] ;
wire \user_io_in_3v3[10] ;
wire \user_io_in_3v3[11] ;
wire \user_io_in_3v3[12] ;
wire \user_io_in_3v3[13] ;
wire \user_io_in_3v3[14] ;
wire \user_io_in_3v3[15] ;
wire \user_io_in_3v3[16] ;
wire \user_io_in_3v3[17] ;
wire \user_io_in_3v3[18] ;
wire \user_io_in_3v3[19] ;
wire \user_io_in_3v3[1] ;
wire \user_io_in_3v3[20] ;
wire \user_io_in_3v3[21] ;
wire \user_io_in_3v3[22] ;
wire \user_io_in_3v3[23] ;
wire \user_io_in_3v3[24] ;
wire \user_io_in_3v3[25] ;
wire \user_io_in_3v3[26] ;
wire \user_io_in_3v3[2] ;
wire \user_io_in_3v3[3] ;
wire \user_io_in_3v3[4] ;
wire \user_io_in_3v3[5] ;
wire \user_io_in_3v3[6] ;
wire \user_io_in_3v3[7] ;
wire \user_io_in_3v3[8] ;
wire \user_io_in_3v3[9] ;
wire \user_io_oeb[0] ;
wire \user_io_oeb[10] ;
wire \user_io_oeb[11] ;
wire \user_io_oeb[12] ;
wire \user_io_oeb[13] ;
wire \user_io_oeb[14] ;
wire \user_io_oeb[15] ;
wire \user_io_oeb[16] ;
wire \user_io_oeb[17] ;
wire \user_io_oeb[18] ;
wire \user_io_oeb[19] ;
wire \user_io_oeb[1] ;
wire \user_io_oeb[20] ;
wire \user_io_oeb[21] ;
wire \user_io_oeb[22] ;
wire \user_io_oeb[23] ;
wire \user_io_oeb[24] ;
wire \user_io_oeb[25] ;
wire \user_io_oeb[26] ;
wire \user_io_oeb[2] ;
wire \user_io_oeb[3] ;
wire \user_io_oeb[4] ;
wire \user_io_oeb[5] ;
wire \user_io_oeb[6] ;
wire \user_io_oeb[7] ;
wire \user_io_oeb[8] ;
wire \user_io_oeb[9] ;
wire \user_io_out[0] ;
wire \user_io_out[10] ;
wire \user_io_out[11] ;
wire \user_io_out[12] ;
wire \user_io_out[13] ;
wire \user_io_out[14] ;
wire \user_io_out[15] ;
wire \user_io_out[16] ;
wire \user_io_out[17] ;
wire \user_io_out[18] ;
wire \user_io_out[19] ;
wire \user_io_out[1] ;
wire \user_io_out[20] ;
wire \user_io_out[21] ;
wire \user_io_out[22] ;
wire \user_io_out[23] ;
wire \user_io_out[24] ;
wire \user_io_out[25] ;
wire \user_io_out[26] ;
wire \user_io_out[2] ;
wire \user_io_out[3] ;
wire \user_io_out[4] ;
wire \user_io_out[5] ;
wire \user_io_out[6] ;
wire \user_io_out[7] ;
wire \user_io_out[8] ;
wire \user_io_out[9] ;
wire \user_irq[0] ;
wire \user_irq[1] ;
wire \user_irq[2] ;
wire \user_irq_core[0] ;
wire \user_irq_core[1] ;
wire \user_irq_core[2] ;
wire \user_irq_ena[0] ;
wire \user_irq_ena[1] ;
wire \user_irq_ena[2] ;
inout vccd;
inout vccd1;
wire vccd1_core;
inout vccd2;
wire vccd2_core;
wire vccd_core;
inout vdda;
inout vdda1;
inout vdda1_2;
wire vdda1_core;
inout vdda2;
wire vdda2_core;
wire vdda_core;
inout vddio;
inout vddio_2;
wire vddio_core;
inout vssa;
inout vssa1;
inout vssa1_2;
wire vssa1_core;
inout vssa2;
wire vssa2_core;
wire vssa_core;
inout vssd;
inout vssd1;
wire vssd1_core;
inout vssd2;
wire vssd2_core;
wire vssd_core;
inout vssio;
inout vssio_2;
wire vssio_core;
caravel_clocking clock_ctrl (
.VGND(vssd_core),
.VPWR(vccd_core),
.core_clk(caravel_clk),
.ext_clk(clock_core_buf),
.ext_clk_sel(ext_clk_sel),
.ext_reset(ext_reset),
.pll_clk(pll_clk),
.pll_clk90(pll_clk90),
.resetb(rstb_l_buf),
.resetb_sync(caravel_rstn),
.sel({ \spi_pll_sel[2] , \spi_pll_sel[1] , \spi_pll_sel[0] }),
.sel2({ \spi_pll90_sel[2] , \spi_pll90_sel[1] , \spi_pll90_sel[0] }),
.user_clk(caravel_clk2)
);
buff_flash_clkrst flash_clkrst_buffers (
.VGND(vssd_core),
.VPWR(vccd_core),
.in_n({ caravel_clk, caravel_rstn, flash_clk_frame, flash_csb_frame, flash_clk_oeb, flash_csb_oeb, flash_io0_oeb, flash_io1_oeb, flash_io0_ieb, flash_io1_ieb, flash_io0_do, flash_io1_do }),
.in_s({ clock_core, flash_io1_di, flash_io0_di }),
.out_n({ clock_core_buf, flash_io1_di_buf, flash_io0_di_buf }),
.out_s({ caravel_clk_buf, caravel_rstn_buf, flash_clk_frame_buf, flash_csb_frame_buf, flash_clk_oeb_buf, flash_csb_oeb_buf, flash_io0_oeb_buf, flash_io1_oeb_buf, flash_io0_ieb_buf, flash_io1_ieb_buf, flash_io0_do_buf, flash_io1_do_buf })
);
gpio_control_block \gpio_control_bidir_1[0] (
.gpio_defaults({ \gpio_defaults[12] , \gpio_defaults[11] , \gpio_defaults[10] , \gpio_defaults[9] , \gpio_defaults[8] , \gpio_defaults[7] , \gpio_defaults[6] , \gpio_defaults[5] , \gpio_defaults[4] , \gpio_defaults[3] , \gpio_defaults[2] , \gpio_defaults[1] , \gpio_defaults[0] }),
.mgmt_gpio_in(\mgmt_io_in[0] ),
.mgmt_gpio_oeb(\mgmt_io_oeb[0] ),
.mgmt_gpio_out(\mgmt_io_out[0] ),
.one(\mprj_io_one[0] ),
.pad_gpio_ana_en(\mprj_io_analog_en[0] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[0] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[0] ),
.pad_gpio_dm({ \mprj_io_dm[2] , \mprj_io_dm[1] , \mprj_io_dm[0] }),
.pad_gpio_holdover(\mprj_io_holdover[0] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[0] ),
.pad_gpio_in(\mprj_io_in[0] ),
.pad_gpio_inenb(\mprj_io_inp_dis[0] ),
.pad_gpio_out(\mprj_io_out[0] ),
.pad_gpio_outenb(\mprj_io_oeb[0] ),
.pad_gpio_slow_sel(\mprj_io_slow_sel[0] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[0] ),
.resetn(\gpio_resetn_1_shifted[0] ),
.resetn_out(\gpio_resetn_1[0] ),
.serial_clock(\gpio_clock_1_shifted[0] ),
.serial_clock_out(\gpio_clock_1[0] ),
.serial_data_in(\gpio_serial_link_1_shifted[0] ),
.serial_data_out(\gpio_serial_link_1[0] ),
.serial_load(\gpio_load_1_shifted[0] ),
.serial_load_out(\gpio_load_1[0] ),
.user_gpio_in(\user_io_in[0] ),
.user_gpio_oeb(\user_io_oeb[0] ),
.user_gpio_out(\user_io_out[0] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero(\mgmt_io_in_hk[14] )
);
gpio_control_block \gpio_control_bidir_1[1] (
.gpio_defaults({ \gpio_defaults[25] , \gpio_defaults[24] , \gpio_defaults[23] , \gpio_defaults[22] , \gpio_defaults[21] , \gpio_defaults[20] , \gpio_defaults[19] , \gpio_defaults[18] , \gpio_defaults[17] , \gpio_defaults[16] , \gpio_defaults[15] , \gpio_defaults[14] , \gpio_defaults[13] }),
.mgmt_gpio_in(\mgmt_io_in[1] ),
.mgmt_gpio_oeb(\mgmt_io_oeb[1] ),
.mgmt_gpio_out(\mgmt_io_out[1] ),
.one(\mprj_io_one[1] ),
.pad_gpio_ana_en(\mprj_io_analog_en[1] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[1] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[1] ),
.pad_gpio_dm({ \mprj_io_dm[5] , \mprj_io_dm[4] , \mprj_io_dm[3] }),
.pad_gpio_holdover(\mprj_io_holdover[1] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[1] ),
.pad_gpio_in(\mprj_io_in[1] ),
.pad_gpio_inenb(\mprj_io_inp_dis[1] ),
.pad_gpio_out(\mprj_io_out[1] ),
.pad_gpio_outenb(\mprj_io_oeb[1] ),
.pad_gpio_slow_sel(\mprj_io_slow_sel[1] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[1] ),
.resetn(\gpio_resetn_1[0] ),
.resetn_out(\gpio_resetn_1[1] ),
.serial_clock(\gpio_clock_1[0] ),
.serial_clock_out(\gpio_clock_1[1] ),
.serial_data_in(\gpio_serial_link_1[0] ),
.serial_data_out(\gpio_serial_link_1[1] ),
.serial_load(\gpio_load_1[0] ),
.serial_load_out(\gpio_load_1[1] ),
.user_gpio_in(\user_io_in[1] ),
.user_gpio_oeb(\user_io_oeb[1] ),
.user_gpio_out(\user_io_out[1] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero(\mgmt_io_in_hk[16] )
);
gpio_control_block \gpio_control_bidir_2[0] (
.gpio_defaults({ \gpio_defaults[324] , \gpio_defaults[323] , \gpio_defaults[322] , \gpio_defaults[321] , \gpio_defaults[320] , \gpio_defaults[319] , \gpio_defaults[318] , \gpio_defaults[317] , \gpio_defaults[316] , \gpio_defaults[315] , \gpio_defaults[314] , \gpio_defaults[313] , \gpio_defaults[312] }),
.mgmt_gpio_in(\mgmt_io_in[35] ),
.mgmt_gpio_oeb(\mgmt_io_oeb[35] ),
.mgmt_gpio_out(\mgmt_io_out[35] ),
.one(\mprj_io_one[24] ),
.pad_gpio_ana_en(\mprj_io_analog_en[24] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[24] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[24] ),
.pad_gpio_dm({ \mprj_io_dm[74] , \mprj_io_dm[73] , \mprj_io_dm[72] }),
.pad_gpio_holdover(\mprj_io_holdover[24] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[24] ),
.pad_gpio_in(\mprj_io_in[24] ),
.pad_gpio_inenb(\mprj_io_inp_dis[24] ),
.pad_gpio_out(\mprj_io_out[24] ),
.pad_gpio_outenb(\mprj_io_oeb[24] ),
.pad_gpio_slow_sel(\mprj_io_slow_sel[24] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[24] ),
.resetn(\gpio_resetn_2[11] ),
.resetn_out(\gpio_resetn_2[10] ),
.serial_clock(\gpio_clock_2[11] ),
.serial_clock_out(\gpio_clock_2[10] ),
.serial_data_in(\gpio_serial_link_2[11] ),
.serial_data_out(\gpio_serial_link_2[10] ),
.serial_load(\gpio_load_2[11] ),
.serial_load_out(\gpio_load_2[10] ),
.user_gpio_in(\user_io_in[24] ),
.user_gpio_oeb(\user_io_oeb[24] ),
.user_gpio_out(\user_io_out[24] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_bidir_2[1] (
.gpio_defaults({ \gpio_defaults[337] , \gpio_defaults[336] , \gpio_defaults[335] , \gpio_defaults[334] , \gpio_defaults[333] , \gpio_defaults[332] , \gpio_defaults[331] , \gpio_defaults[330] , \gpio_defaults[329] , \gpio_defaults[328] , \gpio_defaults[327] , \gpio_defaults[326] , \gpio_defaults[325] }),
.mgmt_gpio_in(\mgmt_io_in[36] ),
.mgmt_gpio_oeb(\mgmt_io_oeb[36] ),
.mgmt_gpio_out(\mgmt_io_out[36] ),
.one(\mprj_io_one[25] ),
.pad_gpio_ana_en(\mprj_io_analog_en[25] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[25] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[25] ),
.pad_gpio_dm({ \mprj_io_dm[77] , \mprj_io_dm[76] , \mprj_io_dm[75] }),
.pad_gpio_holdover(\mprj_io_holdover[25] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[25] ),
.pad_gpio_in(\mprj_io_in[25] ),
.pad_gpio_inenb(\mprj_io_inp_dis[25] ),
.pad_gpio_out(\mprj_io_out[25] ),
.pad_gpio_outenb(\mprj_io_oeb[25] ),
.pad_gpio_slow_sel(\mprj_io_slow_sel[25] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[25] ),
.resetn(\gpio_resetn_2[12] ),
.resetn_out(\gpio_resetn_2[11] ),
.serial_clock(\gpio_clock_2[12] ),
.serial_clock_out(\gpio_clock_2[11] ),
.serial_data_in(\gpio_serial_link_2[12] ),
.serial_data_out(\gpio_serial_link_2[11] ),
.serial_load(\gpio_load_2[12] ),
.serial_load_out(\gpio_load_2[11] ),
.user_gpio_in(\user_io_in[25] ),
.user_gpio_oeb(\user_io_oeb[25] ),
.user_gpio_out(\user_io_out[25] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_bidir_2[2] (
.gpio_defaults({ \gpio_defaults[350] , \gpio_defaults[349] , \gpio_defaults[348] , \gpio_defaults[347] , \gpio_defaults[346] , \gpio_defaults[345] , \gpio_defaults[344] , \gpio_defaults[343] , \gpio_defaults[342] , \gpio_defaults[341] , \gpio_defaults[340] , \gpio_defaults[339] , \gpio_defaults[338] }),
.mgmt_gpio_in(\mgmt_io_in[37] ),
.mgmt_gpio_oeb(\mgmt_io_oeb[37] ),
.mgmt_gpio_out(\mgmt_io_out[37] ),
.one(\mprj_io_one[26] ),
.pad_gpio_ana_en(\mprj_io_analog_en[26] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[26] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[26] ),
.pad_gpio_dm({ \mprj_io_dm[80] , \mprj_io_dm[79] , \mprj_io_dm[78] }),
.pad_gpio_holdover(\mprj_io_holdover[26] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[26] ),
.pad_gpio_in(\mprj_io_in[26] ),
.pad_gpio_inenb(\mprj_io_inp_dis[26] ),
.pad_gpio_out(\mprj_io_out[26] ),
.pad_gpio_outenb(\mprj_io_oeb[26] ),
.pad_gpio_slow_sel(\mprj_io_slow_sel[26] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[26] ),
.resetn(\gpio_resetn_2_shifted[12] ),
.resetn_out(\gpio_resetn_2[12] ),
.serial_clock(\gpio_clock_2_shifted[12] ),
.serial_clock_out(\gpio_clock_2[12] ),
.serial_data_in(\gpio_serial_link_2_shifted[12] ),
.serial_data_out(\gpio_serial_link_2[12] ),
.serial_load(\gpio_load_2_shifted[12] ),
.serial_load_out(\gpio_load_2[12] ),
.user_gpio_in(\user_io_in[26] ),
.user_gpio_oeb(\user_io_oeb[26] ),
.user_gpio_out(\user_io_out[26] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_1[0] (
.gpio_defaults({ \gpio_defaults[116] , \gpio_defaults[115] , \gpio_defaults[114] , \gpio_defaults[113] , \gpio_defaults[112] , \gpio_defaults[111] , \gpio_defaults[110] , \gpio_defaults[109] , \gpio_defaults[108] , \gpio_defaults[107] , \gpio_defaults[106] , \gpio_defaults[105] , \gpio_defaults[104] }),
.mgmt_gpio_in(\mgmt_io_in[8] ),
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.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
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gpio_control_block \gpio_control_in_1[1] (
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.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
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gpio_control_block \gpio_control_in_1[2] (
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.vssd1(vssd1_core),
.zero()
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gpio_control_block \gpio_control_in_1[3] (
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.zero()
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gpio_control_block \gpio_control_in_1[4] (
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.vccd(vccd_core),
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.zero()
);
gpio_control_block \gpio_control_in_1[5] (
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.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
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.zero()
);
gpio_control_block \gpio_control_in_1a[0] (
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.vccd(vccd_core),
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.zero(\mgmt_io_in_hk[18] )
);
gpio_control_block \gpio_control_in_1a[1] (
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.vccd(vccd_core),
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.zero(\mgmt_io_in_hk[20] )
);
gpio_control_block \gpio_control_in_1a[2] (
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.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero(\mgmt_io_in_hk[22] )
);
gpio_control_block \gpio_control_in_1a[3] (
.gpio_defaults({ \gpio_defaults[77] , \gpio_defaults[76] , \gpio_defaults[75] , \gpio_defaults[74] , \gpio_defaults[73] , \gpio_defaults[72] , \gpio_defaults[71] , \gpio_defaults[70] , \gpio_defaults[69] , \gpio_defaults[68] , \gpio_defaults[67] , \gpio_defaults[66] , \gpio_defaults[65] }),
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.pad_gpio_holdover(\mprj_io_holdover[5] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[5] ),
.pad_gpio_in(\mprj_io_in[5] ),
.pad_gpio_inenb(\mprj_io_inp_dis[5] ),
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.pad_gpio_outenb(\mprj_io_oeb[5] ),
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.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[5] ),
.resetn(\gpio_resetn_1[4] ),
.resetn_out(\gpio_resetn_1[5] ),
.serial_clock(\gpio_clock_1[4] ),
.serial_clock_out(\gpio_clock_1[5] ),
.serial_data_in(\gpio_serial_link_1[4] ),
.serial_data_out(\gpio_serial_link_1[5] ),
.serial_load(\gpio_load_1[4] ),
.serial_load_out(\gpio_load_1[5] ),
.user_gpio_in(\user_io_in[5] ),
.user_gpio_oeb(\user_io_oeb[5] ),
.user_gpio_out(\user_io_out[5] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero(\mgmt_io_in_hk[24] )
);
gpio_control_block \gpio_control_in_1a[4] (
.gpio_defaults({ \gpio_defaults[90] , \gpio_defaults[89] , \gpio_defaults[88] , \gpio_defaults[87] , \gpio_defaults[86] , \gpio_defaults[85] , \gpio_defaults[84] , \gpio_defaults[83] , \gpio_defaults[82] , \gpio_defaults[81] , \gpio_defaults[80] , \gpio_defaults[79] , \gpio_defaults[78] }),
.mgmt_gpio_in(\mgmt_io_in[6] ),
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.pad_gpio_dm({ \mprj_io_dm[20] , \mprj_io_dm[19] , \mprj_io_dm[18] }),
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.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[6] ),
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.pad_gpio_inenb(\mprj_io_inp_dis[6] ),
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.serial_data_in(\gpio_serial_link_1[5] ),
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.serial_load(\gpio_load_1[5] ),
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.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero(\mprj_io_zero[6] )
);
gpio_control_block \gpio_control_in_1a[5] (
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.vccd(vccd_core),
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.vssd1(vssd1_core),
.zero(\mprj_io_zero[7] )
);
gpio_control_block \gpio_control_in_2[0] (
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.zero()
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gpio_control_block \gpio_control_in_2[1] (
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.zero()
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gpio_control_block \gpio_control_in_2[2] (
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.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_2[3] (
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.vccd(vccd_core),
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.vssd(vssd_core),
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.zero()
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gpio_control_block \gpio_control_in_2[4] (
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.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_2[5] (
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.vccd(vccd_core),
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.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_2[6] (
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.vccd(vccd_core),
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.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_2[7] (
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.serial_load(\gpio_load_2[8] ),
.serial_load_out(\gpio_load_2[7] ),
.user_gpio_in(\user_io_in[21] ),
.user_gpio_oeb(\user_io_oeb[21] ),
.user_gpio_out(\user_io_out[21] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_2[8] (
.gpio_defaults({ \gpio_defaults[298] , \gpio_defaults[297] , \gpio_defaults[296] , \gpio_defaults[295] , \gpio_defaults[294] , \gpio_defaults[293] , \gpio_defaults[292] , \gpio_defaults[291] , \gpio_defaults[290] , \gpio_defaults[289] , \gpio_defaults[288] , \gpio_defaults[287] , \gpio_defaults[286] }),
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.pad_gpio_ana_sel(\mprj_io_analog_sel[22] ),
.pad_gpio_dm({ \mprj_io_dm[68] , \mprj_io_dm[67] , \mprj_io_dm[66] }),
.pad_gpio_holdover(\mprj_io_holdover[22] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[22] ),
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.user_gpio_in(\user_io_in[22] ),
.user_gpio_oeb(\user_io_oeb[22] ),
.user_gpio_out(\user_io_out[22] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_control_block \gpio_control_in_2[9] (
.gpio_defaults({ \gpio_defaults[311] , \gpio_defaults[310] , \gpio_defaults[309] , \gpio_defaults[308] , \gpio_defaults[307] , \gpio_defaults[306] , \gpio_defaults[305] , \gpio_defaults[304] , \gpio_defaults[303] , \gpio_defaults[302] , \gpio_defaults[301] , \gpio_defaults[300] , \gpio_defaults[299] }),
.mgmt_gpio_in(\mgmt_io_in[34] ),
.mgmt_gpio_oeb(\mprj_io_one[23] ),
.mgmt_gpio_out(\mgmt_io_out[34] ),
.one(\mprj_io_one[23] ),
.pad_gpio_ana_en(\mprj_io_analog_en[23] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[23] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[23] ),
.pad_gpio_dm({ \mprj_io_dm[71] , \mprj_io_dm[70] , \mprj_io_dm[69] }),
.pad_gpio_holdover(\mprj_io_holdover[23] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[23] ),
.pad_gpio_in(\mprj_io_in[23] ),
.pad_gpio_inenb(\mprj_io_inp_dis[23] ),
.pad_gpio_out(\mprj_io_out[23] ),
.pad_gpio_outenb(\mprj_io_oeb[23] ),
.pad_gpio_slow_sel(\mprj_io_slow_sel[23] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[23] ),
.resetn(\gpio_resetn_2[10] ),
.resetn_out(\gpio_resetn_2[9] ),
.serial_clock(\gpio_clock_2[10] ),
.serial_clock_out(\gpio_clock_2[9] ),
.serial_data_in(\gpio_serial_link_2[10] ),
.serial_data_out(\gpio_serial_link_2[9] ),
.serial_load(\gpio_load_2[10] ),
.serial_load_out(\gpio_load_2[9] ),
.user_gpio_in(\user_io_in[23] ),
.user_gpio_oeb(\user_io_oeb[23] ),
.user_gpio_out(\user_io_out[23] ),
.vccd(vccd_core),
.vccd1(vccd1_core),
.vssd(vssd_core),
.vssd1(vssd1_core),
.zero()
);
gpio_defaults_block_1803 gpio_defaults_block_0 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[12] , \gpio_defaults[11] , \gpio_defaults[10] , \gpio_defaults[9] , \gpio_defaults[8] , \gpio_defaults[7] , \gpio_defaults[6] , \gpio_defaults[5] , \gpio_defaults[4] , \gpio_defaults[3] , \gpio_defaults[2] , \gpio_defaults[1] , \gpio_defaults[0] })
);
gpio_defaults_block_1803 gpio_defaults_block_1 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[25] , \gpio_defaults[24] , \gpio_defaults[23] , \gpio_defaults[22] , \gpio_defaults[21] , \gpio_defaults[20] , \gpio_defaults[19] , \gpio_defaults[18] , \gpio_defaults[17] , \gpio_defaults[16] , \gpio_defaults[15] , \gpio_defaults[14] , \gpio_defaults[13] })
);
gpio_defaults_block_000a gpio_defaults_block_10 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[142] , \gpio_defaults[141] , \gpio_defaults[140] , \gpio_defaults[139] , \gpio_defaults[138] , \gpio_defaults[137] , \gpio_defaults[136] , \gpio_defaults[135] , \gpio_defaults[134] , \gpio_defaults[133] , \gpio_defaults[132] , \gpio_defaults[131] , \gpio_defaults[130] })
);
gpio_defaults_block_000a gpio_defaults_block_11 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[155] , \gpio_defaults[154] , \gpio_defaults[153] , \gpio_defaults[152] , \gpio_defaults[151] , \gpio_defaults[150] , \gpio_defaults[149] , \gpio_defaults[148] , \gpio_defaults[147] , \gpio_defaults[146] , \gpio_defaults[145] , \gpio_defaults[144] , \gpio_defaults[143] })
);
gpio_defaults_block_000a gpio_defaults_block_12 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[168] , \gpio_defaults[167] , \gpio_defaults[166] , \gpio_defaults[165] , \gpio_defaults[164] , \gpio_defaults[163] , \gpio_defaults[162] , \gpio_defaults[161] , \gpio_defaults[160] , \gpio_defaults[159] , \gpio_defaults[158] , \gpio_defaults[157] , \gpio_defaults[156] })
);
gpio_defaults_block_000a gpio_defaults_block_13 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[181] , \gpio_defaults[180] , \gpio_defaults[179] , \gpio_defaults[178] , \gpio_defaults[177] , \gpio_defaults[176] , \gpio_defaults[175] , \gpio_defaults[174] , \gpio_defaults[173] , \gpio_defaults[172] , \gpio_defaults[171] , \gpio_defaults[170] , \gpio_defaults[169] })
);
gpio_defaults_block_0403 gpio_defaults_block_2 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[38] , \gpio_defaults[37] , \gpio_defaults[36] , \gpio_defaults[35] , \gpio_defaults[34] , \gpio_defaults[33] , \gpio_defaults[32] , \gpio_defaults[31] , \gpio_defaults[30] , \gpio_defaults[29] , \gpio_defaults[28] , \gpio_defaults[27] , \gpio_defaults[26] })
);
gpio_defaults_block_000a gpio_defaults_block_25 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[194] , \gpio_defaults[193] , \gpio_defaults[192] , \gpio_defaults[191] , \gpio_defaults[190] , \gpio_defaults[189] , \gpio_defaults[188] , \gpio_defaults[187] , \gpio_defaults[186] , \gpio_defaults[185] , \gpio_defaults[184] , \gpio_defaults[183] , \gpio_defaults[182] })
);
gpio_defaults_block_000a gpio_defaults_block_26 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[207] , \gpio_defaults[206] , \gpio_defaults[205] , \gpio_defaults[204] , \gpio_defaults[203] , \gpio_defaults[202] , \gpio_defaults[201] , \gpio_defaults[200] , \gpio_defaults[199] , \gpio_defaults[198] , \gpio_defaults[197] , \gpio_defaults[196] , \gpio_defaults[195] })
);
gpio_defaults_block_000a gpio_defaults_block_27 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[220] , \gpio_defaults[219] , \gpio_defaults[218] , \gpio_defaults[217] , \gpio_defaults[216] , \gpio_defaults[215] , \gpio_defaults[214] , \gpio_defaults[213] , \gpio_defaults[212] , \gpio_defaults[211] , \gpio_defaults[210] , \gpio_defaults[209] , \gpio_defaults[208] })
);
gpio_defaults_block_000a gpio_defaults_block_28 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[233] , \gpio_defaults[232] , \gpio_defaults[231] , \gpio_defaults[230] , \gpio_defaults[229] , \gpio_defaults[228] , \gpio_defaults[227] , \gpio_defaults[226] , \gpio_defaults[225] , \gpio_defaults[224] , \gpio_defaults[223] , \gpio_defaults[222] , \gpio_defaults[221] })
);
gpio_defaults_block_000a gpio_defaults_block_29 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[246] , \gpio_defaults[245] , \gpio_defaults[244] , \gpio_defaults[243] , \gpio_defaults[242] , \gpio_defaults[241] , \gpio_defaults[240] , \gpio_defaults[239] , \gpio_defaults[238] , \gpio_defaults[237] , \gpio_defaults[236] , \gpio_defaults[235] , \gpio_defaults[234] })
);
gpio_defaults_block_0801 gpio_defaults_block_3 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[51] , \gpio_defaults[50] , \gpio_defaults[49] , \gpio_defaults[48] , \gpio_defaults[47] , \gpio_defaults[46] , \gpio_defaults[45] , \gpio_defaults[44] , \gpio_defaults[43] , \gpio_defaults[42] , \gpio_defaults[41] , \gpio_defaults[40] , \gpio_defaults[39] })
);
gpio_defaults_block_000a gpio_defaults_block_30 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[259] , \gpio_defaults[258] , \gpio_defaults[257] , \gpio_defaults[256] , \gpio_defaults[255] , \gpio_defaults[254] , \gpio_defaults[253] , \gpio_defaults[252] , \gpio_defaults[251] , \gpio_defaults[250] , \gpio_defaults[249] , \gpio_defaults[248] , \gpio_defaults[247] })
);
gpio_defaults_block_000a gpio_defaults_block_31 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[272] , \gpio_defaults[271] , \gpio_defaults[270] , \gpio_defaults[269] , \gpio_defaults[268] , \gpio_defaults[267] , \gpio_defaults[266] , \gpio_defaults[265] , \gpio_defaults[264] , \gpio_defaults[263] , \gpio_defaults[262] , \gpio_defaults[261] , \gpio_defaults[260] })
);
gpio_defaults_block_000a gpio_defaults_block_32 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[285] , \gpio_defaults[284] , \gpio_defaults[283] , \gpio_defaults[282] , \gpio_defaults[281] , \gpio_defaults[280] , \gpio_defaults[279] , \gpio_defaults[278] , \gpio_defaults[277] , \gpio_defaults[276] , \gpio_defaults[275] , \gpio_defaults[274] , \gpio_defaults[273] })
);
gpio_defaults_block_000a gpio_defaults_block_33 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[298] , \gpio_defaults[297] , \gpio_defaults[296] , \gpio_defaults[295] , \gpio_defaults[294] , \gpio_defaults[293] , \gpio_defaults[292] , \gpio_defaults[291] , \gpio_defaults[290] , \gpio_defaults[289] , \gpio_defaults[288] , \gpio_defaults[287] , \gpio_defaults[286] })
);
gpio_defaults_block_000a gpio_defaults_block_34 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[311] , \gpio_defaults[310] , \gpio_defaults[309] , \gpio_defaults[308] , \gpio_defaults[307] , \gpio_defaults[306] , \gpio_defaults[305] , \gpio_defaults[304] , \gpio_defaults[303] , \gpio_defaults[302] , \gpio_defaults[301] , \gpio_defaults[300] , \gpio_defaults[299] })
);
gpio_defaults_block_000a gpio_defaults_block_35 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[324] , \gpio_defaults[323] , \gpio_defaults[322] , \gpio_defaults[321] , \gpio_defaults[320] , \gpio_defaults[319] , \gpio_defaults[318] , \gpio_defaults[317] , \gpio_defaults[316] , \gpio_defaults[315] , \gpio_defaults[314] , \gpio_defaults[313] , \gpio_defaults[312] })
);
gpio_defaults_block_000a gpio_defaults_block_36 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[337] , \gpio_defaults[336] , \gpio_defaults[335] , \gpio_defaults[334] , \gpio_defaults[333] , \gpio_defaults[332] , \gpio_defaults[331] , \gpio_defaults[330] , \gpio_defaults[329] , \gpio_defaults[328] , \gpio_defaults[327] , \gpio_defaults[326] , \gpio_defaults[325] })
);
gpio_defaults_block_000a gpio_defaults_block_37 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[350] , \gpio_defaults[349] , \gpio_defaults[348] , \gpio_defaults[347] , \gpio_defaults[346] , \gpio_defaults[345] , \gpio_defaults[344] , \gpio_defaults[343] , \gpio_defaults[342] , \gpio_defaults[341] , \gpio_defaults[340] , \gpio_defaults[339] , \gpio_defaults[338] })
);
gpio_defaults_block_0403 gpio_defaults_block_4 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[64] , \gpio_defaults[63] , \gpio_defaults[62] , \gpio_defaults[61] , \gpio_defaults[60] , \gpio_defaults[59] , \gpio_defaults[58] , \gpio_defaults[57] , \gpio_defaults[56] , \gpio_defaults[55] , \gpio_defaults[54] , \gpio_defaults[53] , \gpio_defaults[52] })
);
gpio_defaults_block_000a gpio_defaults_block_5 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[77] , \gpio_defaults[76] , \gpio_defaults[75] , \gpio_defaults[74] , \gpio_defaults[73] , \gpio_defaults[72] , \gpio_defaults[71] , \gpio_defaults[70] , \gpio_defaults[69] , \gpio_defaults[68] , \gpio_defaults[67] , \gpio_defaults[66] , \gpio_defaults[65] })
);
gpio_defaults_block_000a gpio_defaults_block_6 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[90] , \gpio_defaults[89] , \gpio_defaults[88] , \gpio_defaults[87] , \gpio_defaults[86] , \gpio_defaults[85] , \gpio_defaults[84] , \gpio_defaults[83] , \gpio_defaults[82] , \gpio_defaults[81] , \gpio_defaults[80] , \gpio_defaults[79] , \gpio_defaults[78] })
);
gpio_defaults_block_000a gpio_defaults_block_7 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[103] , \gpio_defaults[102] , \gpio_defaults[101] , \gpio_defaults[100] , \gpio_defaults[99] , \gpio_defaults[98] , \gpio_defaults[97] , \gpio_defaults[96] , \gpio_defaults[95] , \gpio_defaults[94] , \gpio_defaults[93] , \gpio_defaults[92] , \gpio_defaults[91] })
);
gpio_defaults_block_000a gpio_defaults_block_8 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[116] , \gpio_defaults[115] , \gpio_defaults[114] , \gpio_defaults[113] , \gpio_defaults[112] , \gpio_defaults[111] , \gpio_defaults[110] , \gpio_defaults[109] , \gpio_defaults[108] , \gpio_defaults[107] , \gpio_defaults[106] , \gpio_defaults[105] , \gpio_defaults[104] })
);
gpio_defaults_block_000a gpio_defaults_block_9 (
.VGND(vssd_core),
.VPWR(vccd_core),
.gpio_defaults({ \gpio_defaults[129] , \gpio_defaults[128] , \gpio_defaults[127] , \gpio_defaults[126] , \gpio_defaults[125] , \gpio_defaults[124] , \gpio_defaults[123] , \gpio_defaults[122] , \gpio_defaults[121] , \gpio_defaults[120] , \gpio_defaults[119] , \gpio_defaults[118] , \gpio_defaults[117] })
);
housekeeping housekeeping (
.VGND(vssd_core),
.VPWR(vccd_core),
.debug_in(debug_in),
.debug_mode(debug_mode),
.debug_oeb(debug_oeb),
.debug_out(debug_out),
.irq({ \irq_spi[2] , \irq_spi[1] , \irq_spi[0] }),
.mask_rev_in({ \mask_rev[31] , \mask_rev[30] , \mask_rev[29] , \mask_rev[28] , \mask_rev[27] , \mask_rev[26] , \mask_rev[25] , \mask_rev[24] , \mask_rev[23] , \mask_rev[22] , \mask_rev[21] , \mask_rev[20] , \mask_rev[19] , \mask_rev[18] , \mask_rev[17] , \mask_rev[16] , \mask_rev[15] , \mask_rev[14] , \mask_rev[13] , \mask_rev[12] , \mask_rev[11] , \mask_rev[10] , \mask_rev[9] , \mask_rev[8] , \mask_rev[7] , \mask_rev[6] , \mask_rev[5] , \mask_rev[4] , \mask_rev[3] , \mask_rev[2] , \mask_rev[1] , \mask_rev[0] }),
.mgmt_gpio_in({ \mgmt_io_in_hk[37] , \mgmt_io_in_hk[36] , \mgmt_io_in_hk[35] , \mgmt_io_in_hk[34] , \mgmt_io_in_hk[33] , \mgmt_io_in_hk[32] , \mgmt_io_in_hk[31] , \mgmt_io_in_hk[30] , \mgmt_io_in_hk[29] , \mgmt_io_in_hk[28] , \mgmt_io_in_hk[27] , \mgmt_io_in_hk[26] , \mgmt_io_in_hk[25] , \mgmt_io_in_hk[24] , \mgmt_io_in_hk[22] , \mgmt_io_in_hk[22] , \mgmt_io_in_hk[20] , \mgmt_io_in_hk[20] , \mgmt_io_in_hk[18] , \mgmt_io_in_hk[18] , \mgmt_io_in_hk[16] , \mgmt_io_in_hk[16] , \mgmt_io_in_hk[14] , \mgmt_io_in_hk[14] , \mgmt_io_in_hk[13] , \mgmt_io_in_hk[12] , \mgmt_io_in_hk[11] , \mgmt_io_in_hk[10] , \mgmt_io_in_hk[9] , \mgmt_io_in_hk[8] , \mgmt_io_in_hk[7] , \mgmt_io_in[6] , \mgmt_io_in[5] , \mgmt_io_in[4] , \mgmt_io_in[3] , \mgmt_io_in[2] , \mgmt_io_in[1] , \mgmt_io_in[0] }),
.mgmt_gpio_oeb({ \mgmt_io_oeb_hk[37] , \mgmt_io_oeb_hk[36] , \mgmt_io_oeb_hk[35] , \mgmt_io_oeb[34] , \mgmt_io_oeb[33] , \mgmt_io_oeb[32] , \mgmt_io_oeb[31] , \mgmt_io_oeb[30] , \mgmt_io_oeb[29] , \mgmt_io_oeb[28] , \mgmt_io_oeb[27] , \mgmt_io_oeb[26] , \mgmt_io_oeb[25] , \mgmt_io_oeb[24] , \mgmt_io_oeb[23] , \mgmt_io_oeb[22] , \mgmt_io_oeb[21] , \mgmt_io_oeb[20] , \mgmt_io_oeb[19] , \mgmt_io_oeb[18] , \mgmt_io_oeb[17] , \mgmt_io_oeb[16] , \mgmt_io_oeb[15] , \mgmt_io_oeb[14] , \mgmt_io_oeb[13] , \mgmt_io_oeb[12] , \mgmt_io_oeb[11] , \mgmt_io_oeb[10] , \mgmt_io_oeb[9] , \mgmt_io_oeb[8] , \mgmt_io_oeb[7] , \mgmt_io_oeb[6] , \mgmt_io_oeb[5] , \mgmt_io_oeb[4] , \mgmt_io_oeb[3] , \mgmt_io_oeb[2] , \mgmt_io_oeb[1] , \mgmt_io_oeb[0] }),
.mgmt_gpio_out({ \mgmt_io_out_hk[37] , \mgmt_io_out_hk[36] , \mgmt_io_out_hk[35] , \mgmt_io_out_hk[34] , \mgmt_io_out_hk[33] , \mgmt_io_out_hk[32] , \mgmt_io_out_hk[31] , \mgmt_io_out_hk[30] , \mgmt_io_out_hk[29] , \mgmt_io_out_hk[28] , \mgmt_io_out_hk[27] , \mgmt_io_out_hk[26] , \mgmt_io_out_hk[25] , \mgmt_io_out[24] , \mgmt_io_out[23] , \mgmt_io_out[22] , \mgmt_io_out[21] , \mgmt_io_out[20] , \mgmt_io_out[19] , \mgmt_io_out[18] , \mgmt_io_out[17] , \mgmt_io_out[16] , \mgmt_io_out[15] , \mgmt_io_out[14] , \mgmt_io_out_hk[13] , \mgmt_io_out_hk[12] , \mgmt_io_out_hk[11] , \mgmt_io_out_hk[10] , \mgmt_io_out_hk[9] , \mgmt_io_out_hk[8] , \mgmt_io_out_hk[7] , \mgmt_io_out[6] , \mgmt_io_out[5] , \mgmt_io_out[4] , \mgmt_io_out[3] , \mgmt_io_out[2] , \mgmt_io_out[1] , \mgmt_io_out[0] }),
.pad_flash_clk(flash_clk_frame),
.pad_flash_clk_oeb(flash_clk_oeb),
.pad_flash_csb(flash_csb_frame),
.pad_flash_csb_oeb(flash_csb_oeb),
.pad_flash_io0_di(flash_io0_di_buf),
.pad_flash_io0_do(flash_io0_do),
.pad_flash_io0_ieb(flash_io0_ieb),
.pad_flash_io0_oeb(flash_io0_oeb),
.pad_flash_io1_di(flash_io1_di_buf),
.pad_flash_io1_do(flash_io1_do),
.pad_flash_io1_ieb(flash_io1_ieb),
.pad_flash_io1_oeb(flash_io1_oeb),
.pll90_sel({ \spi_pll90_sel[2] , \spi_pll90_sel[1] , \spi_pll90_sel[0] }),
.pll_bypass(ext_clk_sel),
.pll_dco_ena(spi_pll_dco_ena),
.pll_div({ \spi_pll_div[4] , \spi_pll_div[3] , \spi_pll_div[2] , \spi_pll_div[1] , \spi_pll_div[0] }),
.pll_ena(spi_pll_ena),
.pll_sel({ \spi_pll_sel[2] , \spi_pll_sel[1] , \spi_pll_sel[0] }),
.pll_trim({ \spi_pll_trim[25] , \spi_pll_trim[24] , \spi_pll_trim[23] , \spi_pll_trim[22] , \spi_pll_trim[21] , \spi_pll_trim[20] , \spi_pll_trim[19] , \spi_pll_trim[18] , \spi_pll_trim[17] , \spi_pll_trim[16] , \spi_pll_trim[15] , \spi_pll_trim[14] , \spi_pll_trim[13] , \spi_pll_trim[12] , \spi_pll_trim[11] , \spi_pll_trim[10] , \spi_pll_trim[9] , \spi_pll_trim[8] , \spi_pll_trim[7] , \spi_pll_trim[6] , \spi_pll_trim[5] , \spi_pll_trim[4] , \spi_pll_trim[3] , \spi_pll_trim[2] , \spi_pll_trim[1] , \spi_pll_trim[0] }),
.porb(porb_l),
.pwr_ctrl_out({ \pwr_ctrl_nc[3] , \pwr_ctrl_nc[2] , \pwr_ctrl_nc[1] , \pwr_ctrl_nc[0] }),
.qspi_enabled(qspi_enabled),
.reset(ext_reset),
.ser_rx(ser_rx),
.ser_tx(ser_tx),
.serial_clock(\gpio_clock_1_shifted[0] ),
.serial_data_1(\gpio_serial_link_1_shifted[0] ),
.serial_data_2(mprj_io_loader_data_2),
.serial_load(\gpio_load_1_shifted[0] ),
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.vccd(vccd_core),
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.VGND(vssd_core),
.VPWR(vccd_core),
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endmodule