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| # Created by write_sdc |
| # Sun May 8 16:50:30 2022 |
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| current_design leaf_chip |
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| # Timing Constraints |
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| create_clock -name clk -period 20.0000 [get_ports {clk}] |
| set_clock_transition 0.1500 [get_clocks {clk}] |
| set_clock_uncertainty 0.2500 clk |
| set_propagated_clock [get_clocks {clk}] |
| set_input_delay 4.0000 -clock [get_clocks {clk}] -add_delay [get_ports {reset}] |
| set_input_delay 4.0000 -clock [get_clocks {clk}] -add_delay [get_ports {rx}] |
| set_output_delay 4.0000 -clock [get_clocks {clk}] -add_delay [get_ports {tx}] |
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| # Environment |
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| set_load -pin_load 0.0334 [get_ports {tx}] |
| set_driving_cell -lib_cell sky130_fd_sc_hd__inv_2 -pin {Y} -input_transition_rise 0.0000 -input_transition_fall 0.0000 [get_ports {clk}] |
| set_driving_cell -lib_cell sky130_fd_sc_hd__inv_2 -pin {Y} -input_transition_rise 0.0000 -input_transition_fall 0.0000 [get_ports {reset}] |
| set_driving_cell -lib_cell sky130_fd_sc_hd__inv_2 -pin {Y} -input_transition_rise 0.0000 -input_transition_fall 0.0000 [get_ports {rx}] |
| set_timing_derate -early 0.9500 |
| set_timing_derate -late 1.0500 |
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| # Design Rules |
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| set_max_fanout 5.0000 [current_design] |
