module user_project_wrapper (user_clock2,
    vccd1,
    vccd2,
    vdda1,
    vdda2,
    vssa1,
    vssa2,
    vssd1,
    vssd2,
    wb_clk_i,
    wb_rst_i,
    wbs_ack_o,
    wbs_cyc_i,
    wbs_stb_i,
    wbs_we_i,
    analog_io,
    io_in,
    io_oeb,
    io_out,
    la_data_in,
    la_data_out,
    la_oenb,
    user_irq,
    wbs_adr_i,
    wbs_dat_i,
    wbs_dat_o,
    wbs_sel_i);
 input user_clock2;
 input vccd1;
 input vccd2;
 input vdda1;
 input vdda2;
 input vssa1;
 input vssa2;
 input vssd1;
 input vssd2;
 input wb_clk_i;
 input wb_rst_i;
 output wbs_ack_o;
 input wbs_cyc_i;
 input wbs_stb_i;
 input wbs_we_i;
 inout [28:0] analog_io;
 input [37:0] io_in;
 output [37:0] io_oeb;
 output [37:0] io_out;
 input [127:0] la_data_in;
 output [127:0] la_data_out;
 input [127:0] la_oenb;
 output [2:0] user_irq;
 input [31:0] wbs_adr_i;
 input [31:0] wbs_dat_i;
 output [31:0] wbs_dat_o;
 input [3:0] wbs_sel_i;

 wire \sram_addr_a[0] ;
 wire \sram_addr_a[1] ;
 wire \sram_addr_a[2] ;
 wire \sram_addr_a[3] ;
 wire \sram_addr_a[4] ;
 wire \sram_addr_a[5] ;
 wire \sram_addr_a[6] ;
 wire \sram_addr_a[7] ;
 wire \sram_addr_a[8] ;
 wire \sram_addr_b[0] ;
 wire \sram_addr_b[1] ;
 wire \sram_addr_b[2] ;
 wire \sram_addr_b[3] ;
 wire \sram_addr_b[4] ;
 wire \sram_addr_b[5] ;
 wire \sram_addr_b[6] ;
 wire \sram_addr_b[7] ;
 wire \sram_addr_b[8] ;
 wire sram_csb_a;
 wire sram_csb_b;
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 wire \sram_din_b[16] ;
 wire \sram_din_b[17] ;
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 wire \sram_din_b[19] ;
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 wire \sram_dout_a[9] ;
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 wire \trng_buffer_o[9] ;
 wire wb_ack_o;
 wire \wb_adr_i[0] ;
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 wire \wb_adr_i[4] ;
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 wire \wb_dat_o[27] ;
 wire \wb_dat_o[28] ;
 wire \wb_dat_o[29] ;
 wire \wb_dat_o[2] ;
 wire \wb_dat_o[30] ;
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 wire \wb_dat_o[3] ;
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 wire \wb_dat_o[5] ;
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 wire \wb_dat_o[7] ;
 wire \wb_dat_o[8] ;
 wire \wb_dat_o[9] ;
 wire wb_stb_i;
 wire wb_we_i;

 user_proj_example mprj (.sram_csb_a(sram_csb_a),
    .sram_csb_b(sram_csb_b),
    .sram_web_b(sram_web_b),
    .trng_wb_ack_i(wb_ack_o),
    .trng_wb_cyc_o(wb_cyc_i),
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    .trng_wb_we_o(wb_we_i),
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    .vssd1(vssd1),
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    .wb_rst_i(wb_rst_i),
    .wbs_ack_o(wbs_ack_o),
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    .wbs_we_i(wbs_we_i),
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