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/* Generated by Yosys 0.9+3621 (git sha1 84e9fa7, gcc 8.3.1 -fPIC -Os) */
module caravel(vddio, vssio, vdda, vssa, vccd, vssd, vdda1, vdda2, vssa1, vssa2, vccd1, vccd2, vssd1, vssd2, gpio, mprj_io, pwr_ctrl_out, clock, resetb, flash_csb, flash_clk, flash_io0, flash_io1);
wire caravel_clk;
wire caravel_clk2;
wire caravel_rstn;
input clock;
wire clock_core;
output flash_clk;
wire flash_clk_core;
wire flash_clk_ieb_core;
wire flash_clk_oeb_core;
output flash_csb;
wire flash_csb_core;
wire flash_csb_ieb_core;
wire flash_csb_oeb_core;
output flash_io0;
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wire flash_io0_ieb_core;
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output flash_io1;
wire flash_io1_di_core;
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wire flash_io2_di_core;
wire flash_io2_do_core;
wire flash_io2_ieb_core;
wire flash_io2_oeb_core;
wire flash_io3_di_core;
wire flash_io3_do_core;
wire flash_io3_ieb_core;
wire flash_io3_oeb_core;
inout gpio;
wire gpio_in_core;
wire gpio_inenb_core;
wire gpio_mode0_core;
wire gpio_mode1_core;
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wire porb_l;
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input resetb;
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inout vccd;
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inout vccd2;
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inout vdda2;
inout vddio;
inout vssa;
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inout vssa2;
inout vssd;
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inout vssd2;
inout vssio;
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.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
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gpio_control_block \gpio_control_bidir[1] (
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.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
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gpio_control_block \gpio_control_in[10] (
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.serial_clock(mprj_io_loader_clock),
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.user_gpio_oeb(\user_io_oeb[10] ),
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.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
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gpio_control_block \gpio_control_in[11] (
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.resetn(mprj_io_loader_resetn),
.serial_clock(mprj_io_loader_clock),
.serial_data_in(\gpio_serial_link[10] ),
.serial_data_out(\gpio_serial_link[11] ),
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.user_gpio_oeb(\user_io_oeb[11] ),
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.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
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gpio_control_block \gpio_control_in[12] (
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.resetn(mprj_io_loader_resetn),
.serial_clock(mprj_io_loader_clock),
.serial_data_in(\gpio_serial_link[11] ),
.serial_data_out(\gpio_serial_link[12] ),
.user_gpio_in(\user_io_in[12] ),
.user_gpio_oeb(\user_io_oeb[12] ),
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.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
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gpio_control_block \gpio_control_in[13] (
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.pad_gpio_in(\mprj_io_in[13] ),
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.pad_gpio_slow_sel(\mprj_io_slow_sel[13] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[13] ),
.resetn(mprj_io_loader_resetn),
.serial_clock(mprj_io_loader_clock),
.serial_data_in(\gpio_serial_link[12] ),
.serial_data_out(\gpio_serial_link[13] ),
.user_gpio_in(\user_io_in[13] ),
.user_gpio_oeb(\user_io_oeb[13] ),
.user_gpio_out(\user_io_out[13] ),
.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
);
gpio_control_block \gpio_control_in[14] (
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.pad_gpio_in(\mprj_io_in[14] ),
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.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[14] ),
.resetn(mprj_io_loader_resetn),
.serial_clock(mprj_io_loader_clock),
.serial_data_in(\gpio_serial_link[13] ),
.serial_data_out(\gpio_serial_link[14] ),
.user_gpio_in(\user_io_in[14] ),
.user_gpio_oeb(\user_io_oeb[14] ),
.user_gpio_out(\user_io_out[14] ),
.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
);
gpio_control_block \gpio_control_in[15] (
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.pad_gpio_slow_sel(\mprj_io_slow_sel[15] ),
.pad_gpio_vtrip_sel(\mprj_io_vtrip_sel[15] ),
.resetn(mprj_io_loader_resetn),
.serial_clock(mprj_io_loader_clock),
.serial_data_in(\gpio_serial_link[14] ),
.serial_data_out(\gpio_serial_link[15] ),
.user_gpio_in(\user_io_in[15] ),
.user_gpio_oeb(\user_io_oeb[15] ),
.user_gpio_out(\user_io_out[15] ),
.vccd(vccd),
.vccd1(vccd1),
.vssd(vssd),
.vssd1(vssd1),
.zero()
);
gpio_control_block \gpio_control_in[16] (
.mgmt_gpio_in(\mgmt_io_in[16] ),
.mgmt_gpio_oeb(\one_loop[16] ),
.mgmt_gpio_out(\mgmt_io_in[16] ),
.one(\one_loop[16] ),
.pad_gpio_ana_en(\mprj_io_analog_en[16] ),
.pad_gpio_ana_pol(\mprj_io_analog_pol[16] ),
.pad_gpio_ana_sel(\mprj_io_analog_sel[16] ),
.pad_gpio_dm({ \mprj_io_dm[50] , \mprj_io_dm[49] , \mprj_io_dm[48] }),
.pad_gpio_holdover(\mprj_io_holdover[16] ),
.pad_gpio_ib_mode_sel(\mprj_io_ib_mode_sel[16] ),
.pad_gpio_in(\mprj_io_in[16] ),
.pad_gpio_inenb(\mprj_io_inp_dis[16] ),
.pad_gpio_out(\mprj_io_out[16] ),
.pad_gpio_outenb(\mprj_io_oeb[16] ),