blob: 753ce2eda46b1327ab692c435a499d9952227096 [file] [log] [blame]
module user_project_wrapper (user_clock2,
vccd1,
vccd2,
vdda1,
vdda2,
vssa1,
vssa2,
vssd1,
vssd2,
wb_clk_i,
wb_rst_i,
wbs_ack_o,
wbs_cyc_i,
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wbs_we_i,
analog_io,
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la_data_in,
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la_oenb,
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wbs_dat_o,
wbs_sel_i);
input user_clock2;
input vccd1;
input vccd2;
input vdda1;
input vdda2;
input vssa1;
input vssa2;
input vssd1;
input vssd2;
input wb_clk_i;
input wb_rst_i;
output wbs_ack_o;
input wbs_cyc_i;
input wbs_stb_i;
input wbs_we_i;
inout [28:0] analog_io;
input [37:0] io_in;
output [37:0] io_oeb;
output [37:0] io_out;
input [127:0] la_data_in;
output [127:0] la_data_out;
input [127:0] la_oenb;
output [2:0] user_irq;
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output [31:0] wbs_dat_o;
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wire \openram_addr0[0] ;
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wire \openram_addr0[7] ;
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wire \openram_din0[17] ;
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wire \openram_din0[19] ;
wire \openram_din0[1] ;
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_NC2,
_NC3,
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\openram_dout0[14] ,
\openram_dout0[13] ,
\openram_dout0[12] ,
\openram_dout0[11] ,
\openram_dout0[10] ,
\openram_dout0[9] ,
\openram_dout0[8] ,
\openram_dout0[7] ,
\openram_dout0[6] ,
\openram_dout0[5] ,
\openram_dout0[4] ,
\openram_dout0[3] ,
\openram_dout0[2] ,
\openram_dout0[1] ,
\openram_dout0[0] }),
.dout1({_NC9,
_NC10,
_NC11,
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.wmask0({\openram_wmask0[3] ,
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\openram_wmask0[1] ,
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la_oenb[39],
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la_oenb[37],
la_oenb[36],
la_oenb[35],
la_oenb[34],
la_oenb[33],
la_oenb[32]}));
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io_oeb[10],
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io_oeb[5],
io_oeb[4],
io_oeb[3],
io_oeb[2],
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.io_out({io_out[37],
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la_data_in[34],
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.la1_oenb({la_oenb[63],
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