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/* Generated by Yosys 0.9+4052 (git sha1 d061b0e, gcc 8.3.1 -fPIC -Os) */
module caravel(vddio, vddio_2, vssio, vssio_2, vdda, vssa, vccd, vssd, vdda1, vdda1_2, vdda2, vssa1, vssa1_2, vssa2, vccd1, vccd2, vssd1, vssd2, gpio, mprj_io, clock, resetb, flash_csb, flash_clk, flash_io0, flash_io1);
wire caravel_clk;
wire caravel_clk2;
wire caravel_rstn;
input clock;
wire clock_core;
wire debug_in;
wire debug_mode;
wire debug_oeb;
wire debug_out;
wire ext_clk_sel;
wire ext_reset;
output flash_clk;
wire flash_clk_core;
wire flash_clk_frame;
wire flash_clk_ieb;
wire flash_clk_ieb_core;
wire flash_clk_oeb;
wire flash_clk_oeb_core;
output flash_csb;
wire flash_csb_core;
wire flash_csb_frame;
wire flash_csb_ieb;
wire flash_csb_ieb_core;
wire flash_csb_oeb;
wire flash_csb_oeb_core;
output flash_io0;
wire flash_io0_di;
wire flash_io0_di_core;
wire flash_io0_do;
wire flash_io0_do_core;
wire flash_io0_ieb;
wire flash_io0_ieb_core;
wire flash_io0_oeb;
wire flash_io0_oeb_core;
output flash_io1;
wire flash_io1_di;
wire flash_io1_di_core;
wire flash_io1_do;
wire flash_io1_do_core;
wire flash_io1_ieb;
wire flash_io1_ieb_core;
wire flash_io1_oeb;
wire flash_io1_oeb_core;
wire flash_io2_di_core;
wire flash_io2_do_core;
wire flash_io2_ieb_core;
wire flash_io2_oeb_core;
wire flash_io3_di_core;
wire flash_io3_do_core;
wire flash_io3_ieb_core;
wire flash_io3_oeb_core;
inout gpio;
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wire \gpio_clock_1[11] ;
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wire \gpio_clock_1[13] ;
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